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W40S11-23XT PDF预览

W40S11-23XT

更新时间： 2024-11-16 20:05:55
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
11页 188K
描述
Low Skew Clock Driver, W40 Series, 13 True Output(s), 0 Inverted Output(s), CMOS, PDSO28, 0.173 INCH, TSSOP-28

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W40S11-23XT 技术参数

生命周期：Obsolete零件包装代码：SSOP
包装说明：TSSOP,针数：28
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.75系列：W40
输入调节：STANDARDJESD-30 代码：R-PDSO-G28
长度：9.7 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
功能数量：1反相输出次数：
端子数量：28实输出次数：13
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟（tpd）：5 ns认证状态：Not Qualified
Same Edge Skew-Max（tskwd）：0.25 ns座面最大高度：1.2 mm
最大供电电压 (Vsup)：3.465 V最小供电电压 (Vsup)：3.135 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL宽度：4.4 mm
最小 fmax：133 MHzBase Number Matches：1

W40S11-23XT 数据手册

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1W40S11-23  
W40S11-23  
Clock Buffer/Driver  
Features  
Key Specifications  
• Thirteen skew-controlled CMOS clock outputs  
(SDRAM0:12)  
• Supports three SDRAM DIMMs  
• Ideal for high-performance systems designed around  
Intel’s latest chip set  
• SMBus serial configuration interface  
• ClockSkew betweenanytwooutputsislessthan250ps  
• 1- to 5-ns propagation delay  
• DC to 133-MHz operation  
• Single 3.3V supply voltage  
• Low power CMOS design packaged in a 28-pin, 300-mil  
SOIC (Small Outline Integrated Circuit), 28-pin, 173-mil  
(Thin Shrink Small Outline Package), and 28-pin,  
209-mil SSOP (Small Shrink Outline Package)  
Supply Voltages:........................................... VDD = 3.3V±5%  
Operating Temperature:.................................... 0°C to +70°C  
Input Threshold: ..................................................1.5V typical  
Maximum Input Voltage:.......................................VDD + 0.5V  
Input Frequency:............................................... 0 to 133 MHz  
BUF_IN to SDRAM0:12 Propagation Delay: ......1.0 to 5.0 ns  
Output Edge Rate:.............................................. >1.5 V/ns  
Output Clock Skew:.................................................. ±250 ps  
Output Duty Cycle: .................................. 45/55% worst case  
Output Impedance:...............................................15Ω typical  
Output Type: ................................................CMOS rail-to-rail  
Overview  
The Cypress W40S11-23 is a low-voltage, thirteen-output  
clock buffer. Output buffer impedance is approximately 15Ω,  
which is ideal for driving SDRAM DIMMs.  
Pin Configuration  
Block Diagram  
SOIC  
SDATA  
SCLOCK  
Serial Port  
Device Control  
VDD  
SDRAM0  
SDRAM1  
GND  
1
2
3
4
5
6
7
8
28  
27  
26  
25  
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
VDD  
SDRAM0  
SDRAM1  
SDRAM2  
SDRAM3  
SDRAM4  
SDRAM5  
SDRAM6  
SDRAM11  
SDRAM10  
GND  
VDD  
VDD  
SDRAM2  
SDRAM3  
GND  
SDRAM9  
SDRAM8  
GND  
BUF_IN  
SDRAM4  
SDRAM5  
SDRAM12  
VDD  
9
VDD  
10  
11  
12  
13  
14  
SDRAM7  
SDRAM6  
GND  
GND  
SCLOCK  
SDRAM7  
SDRAM8  
SDRAM9  
SDRAM10  
SDRAM11  
[1]  
[1]  
SDATA  
BUF_IN  
Note:  
1. Internal pull-up resistor of 250K on SDATA and SCLOCK inputs  
(not CMOS level).  
SDRAM12  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
April 6, 2001  
1234567...11

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与W40S11-23XT相关器件

型号 品牌 获取价格 描述 数据表
W40S11-23Z CYPRESS

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 		Low Skew Clock Driver, 13 True Output(s), 0 Inverted Output(s), CMOS, PDSO28, 0.209 INCH,
W40S12-24G CYPRESS

获取价格

 		Low Skew Clock Driver, S Series, 16 True Output(s), 0 Inverted Output(s), CMOS, PDSO32, 0.
W4120 PULSE

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