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VSC6110

更新时间： 2024-11-23 19:43:51

品牌	Logo	应用领域
VITESSE		驱动逻辑集成电路
页数	文件大小	规格书
10页	148K
描述
PLL Based Clock Driver, VSC61 Series, 18 True Output(s), 0 Inverted Output(s), PQFP64, 10 X 10 MM, THERMALLY ENHANCED, PLASTIC, QFP-64

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VSC6110 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	FQFP,	针数：	64
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.84	系列：	VSC61
输入调节：	DIFFERENTIAL	JESD-30 代码：	S-PQFP-G64
长度：	10 mm	逻辑集成电路类型：	PLL BASED CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	64	实输出次数：	18
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	FQFP
封装形状：	SQUARE	封装形式：	FLATPACK, FINE PITCH
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.5 ns
座面最大高度：	2.45 mm	最大供电电压 (Vsup)：	3.465 V
最小供电电压 (Vsup)：	3.135 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	10 mm
最小 fmax：	500 MHz	Base Number Matches：	1

VSC6110 数据手册

VITESSE

SEMICONDUCTOR CORPORATION

Advance Product Information

Low Jitter

Clock Multiplier and Distributor

VSC6108/10/12

Features

• Recommended Companion for VSC6250 500MHz

• Very Low Jitter: 4ps rms, 25ps Peak-to-Peak

• 10µs Lock Time

Deskew IC and Vitesse Timing Generator ICs

• Input Clock Frequency: 50MHz to 622MHz

• Output Clock Frequency: 100MHz to 1.25GHz

• 1 Differential ECL or PECL Clock Input

• 18 Differential ECL or PECL Clock Outputs

• < 50ps Skew Between Outputs

• Single Supply: 3.3V + 5% @ 2 Watts

• Commercial (0 to +70 C) Temperature Range

• Package: 10mm x 10mm 64 PQFP

General Description

The VSC6108/10/12 are a family of low-jitter clock multiplication and distribution ICs. Each IC uses a

phase locked-loop to lock an on-chip low-noise VCO to an off-chip reference frequency. The VCO output can

be divided down and is output to 18 differential ECL outputs. The VSC6108/10/12 are packaged in a 10 mm x

10 mm 64-pin plastic quad flat pack and consume less than 2 Watts from a single 3.3V power supply.

The VSC6108/10/12 provide high-precision clocks for ATE, instrumentation, telecommunications, data-

communications, and computer system applications where jitter and skew are critical timing parameters. Skew

between outputs is less than 50 ps. Jitter is less than 4 ps rms or 25 ps peak-to-peak. Lock time is 10 µs.

VSC6108/10/12 Functional Block Diagram

OUT0

OUT0N

OUT1

OUT1N

Bypass

Phase

Detector

Loop

Filter

INN

VCO

2,4,8,16

4,8,16,32

FISEL1

FISEL0

OUT17

OUT17N

FOSEL2

FOSEL1

FOSEL0

G52224-0, Rev 2.1

2/15/99

VITESSE SEMICONDUCTOR CORPORATION

741 Calle Plano, Camarillo, CA 93012 • 805/388-3700 • FAX: 805/987-5896

Page 1

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与VSC6110相关器件

型号	品牌	获取价格	描述	数据表
VSC6112	VITESSE	获取价格	PLL Based Clock Driver, VSC61 Series, 18 True Output(s), 0 Inverted Output(s), PQFP64, 10
VSC6134	VITESSE	获取价格	Advanced 10 Gb/s Transport Processor with Enhanced FEC
VSC6134ST-01	VITESSE	获取价格	Micro Peripheral IC,
VSC6134XST	VITESSE	获取价格	Micro Peripheral IC,
VSC6134XST-01	VITESSE	获取价格	Micro Peripheral IC,
VSC6250	VITESSE	获取价格	1Gb/s 16-Channel Drive-Side Deskew IC
VSC6250QW	VITESSE	获取价格	1Gb/s 16-Channel Drive-Side Deskew IC
VSC6280	VITESSE	获取价格	Logic Circuit, GAAS, PQFP128, PLASTIC, QFP-128
VSC6281	MICROSEMI	获取价格	Logic Circuit, GAAS, PQFP128, PLASTIC, QFP-128
VSC6282	VITESSE	获取价格	Logic Circuit, GAAS, PQFP128, PLASTIC, QFP-128

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