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TMS320C6205DGWT200

更新时间： 2024-10-28 11:08:03

品牌	Logo	应用领域
德州仪器 - TI		时钟外围集成电路数字信号处理器装置
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定点数字信号处理器 \| GWT \| 288 \| 0 to 90

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TMS320C6205DGWT200 技术参数

生命周期：	Active	包装说明：	LFBGA, BGA288,19X19,32
Reach Compliance Code：	unknown	其他特性：	ALSO REQUIRES 3.3V SUPPLY
地址总线宽度：	32	桶式移位器：	NO
位大小：	32	边界扫描：	YES
最大时钟频率：	200 MHz	外部数据总线宽度：	32
格式：	FIXED POINT	集成缓存：	YES
内部总线架构：	MULTIPLE	JESD-30 代码：	S-PBGA-B288
长度：	16 mm	低功率模式：	YES
DMA 通道数量：	4	外部中断装置数量：	4
端子数量：	288	计时器数量：	2
片上数据RAM宽度：	8	片上程序ROM宽度：	8
最高工作温度：	90 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFBGA
封装等效代码：	BGA288,19X19,32	封装形状：	SQUARE
封装形式：	GRID ARRAY, LOW PROFILE, FINE PITCH	RAM（字数）：	65536
ROM可编程性：	FLASH	座面最大高度：	1.4 mm
最大压摆率：	290 mA	最大供电电压：	1.57 V
最小供电电压：	1.43 V	标称供电电压：	1.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	OTHER	端子形式：	BALL
端子节距：	0.8 mm	端子位置：	BOTTOM
宽度：	16 mm	uPs/uCs/外围集成电路类型：	DIGITAL SIGNAL PROCESSOR, OTHER
Base Number Matches：	1

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TMS320C6205

FIXED-POINT DIGITAL SIGNAL PROCESSOR

SPRS106E − OCTOBER 1999 − REVISED MARCH 2004

High-Performance Fixed-Point Digital

Signal Processor (DSP) − TMS320C6205

− 5-ns Instruction Cycle Time

− 200-MHz Clock Rate

− Eight 32-Bit Instructions/Cycle

− 1600 MIPS

32-Bit/33-MHz

Interconnect (PCI) Master/Slave Interface

Conforms to:

Peripheral

Component

PCI Specification 2.2

Power Management Interface 1.1

Meets Requirements of PC99

− PCI Access to All On-Chip RAM,

Peripherals, and External Memory

(via EMIF)

− Four 8-Deep x 32-Wide FIFOs for

Efficient PCI Bus Data Transfer

− 3.3/5-V PCI Operation

− Three PCI Bus Address Registers:

Prefetchable Memory

Non-Prefetchable Memory I/O

− Supports 4-Wire Serial EEPROM

Interface

VelociTI Advanced-Very-Long-Instruction-

Word (VLIW) TMS320C62x DSP Core

− Eight Highly Independent Functional

Units:

− Six ALUs (32-/40-Bit)

− Two 16-Bit Multipliers (32-Bit Result)

− Load-Store Architecture With 32 32-Bit

General-Purpose Registers

− Instruction Packing Reduces Code Size

− All Instructions Conditional

Instruction Set Features

− Byte-Addressable (8-, 16-, 32-Bit Data)

− 8-Bit Overflow Protection

− Saturation

− Bit-Field Extract, Set, Clear

− Bit-Counting

− PCI Interrupt Request Under DSP

Program Control

− DSP Interrupt Via PCI I/O Cycle

Two Multichannel Buffered Serial Ports

(McBSPs)

− Direct Interface to T1/E1, MVIP, SCSA

Framers

− ST-Bus-Switching Compatible

− Up to 256 Channels Each

− AC97-Compatible

− Serial-Peripheral-Interface (SPI)

Compatible (Motorola)

− Normalization

1M-Bit On-Chip SRAM

− 512K-Bit Internal Program/Cache

(16K 32-Bit Instructions)

− 512K-Bit Dual-Access Internal Data

(64K Bytes)

− Organized as Two 32K-Byte Blocks for

Improved Concurrency

Two 32-Bit General-Purpose Timers

†

IEEE-1149.1 (JTAG )

Boundary-Scan-Compatible

32-Bit External Memory Interface (EMIF)

− Glueless Interface to Synchronous

Memories: SDRAM or SBSRAM

− Glueless Interface to Asynchronous

Memories: SRAM and EPROM

− 52M-Byte Addressable External Memory

Space

288-Pin MicroStar BGA Package

(GHK Suffix)

0.15-µm/5-Level Metal Process

− CMOS Technology

3.3-V I/Os, 1.5-V Internal, 5-V Voltage

Tolerance for PCI I/O Pins

Four-Channel Bootloading

Direct-Memory-Access (DMA) Controller

With an Auxiliary Channel

Flexible Phase-Locked-Loop (PLL) Clock

Generator

Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of

Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.

VelociTI, TMS320C62x, and MicroStar BGA are trademarks of Texas Instruments.

Motorola is a trademark of Motorola, Inc.

†

IEEE Standard 1149.1-1990 Standard-Test-Access Port and Boundary Scan Architecture.

PRODUCTION DATA information is current as of publication date.

Products conform to specifications per the terms of Texas Instruments

standard warranty. Production processing does not necessarily include

testing of all parameters.

POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443

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