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TM2TR64EPH

更新时间： 2022-03-30 15:33:11

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德州仪器 - TI		/
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22页	365K
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SYNCHRONOUS DYNAMIC RAM MODULES

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TM2TR64EPH 数据手册

ꢀ ꢁ ꢂꢀ ꢃ ꢄ ꢅ ꢆꢇ ꢈꢉ ꢀꢁ ꢅ ꢀꢃꢄ ꢅ ꢆ ꢇ ꢈ

ꢀ ꢁ ꢂꢀ ꢃ ꢊ ꢂ ꢆꢇ ꢈꢉ ꢀꢁ ꢅ ꢀꢃꢊ ꢂ ꢆ ꢇ ꢈ

ꢋ ꢌꢍꢎ ꢈ ꢃ ꢏꢍꢏꢐ ꢋ ꢑꢌ ꢍꢒ ꢁꢓ ꢎ ꢃꢒ ꢁ ꢁꢏ ꢑꢐꢔ ꢆꢋ

SMMS702B − JANUARY 1998 − REVISED APRIL 1998

TM4TR72EPH functional block diagram

U[0:8], UB[0:8]

Two 0.1 µF per

SDRAM device

U[0:8], UB[0:8]

UB0

UB4

DQMB0

DQ[0:7]

DQM

DQMB4

DQM

DQ[0:7]

DQ[32:39]

DQ[0:7]

R = 10 Ω

= 10 Ω

= 5 Ω

UB1

UB5

CK: U0, U4

CK0

CK1

DQMB1

DQM

DQMB5

DQM

CK: U1, U5, U8

DQ[8:15]

DQ[0:7]

DQ[40:47]

DQ[0:7]

CK: UB0, UB4

CK: UB1, UB5, UB8

CK: U2, U6

CK: U3, U7

UB8

†

CK2

DQMB1

CB[0:7]

DQM

DQ[0:7]

CK: UB2, UB6

CK: UB3, UB7

†

CK3

10 kΩ

CKE: UB[0:8]

CKE1

CKE0

RAS

UB2

UB6

CKE: U[0:8]

DQMB2

DQM

DQMB6

DQM

RAS: U[0:8], UB[0:8]

CAS: U[0:8], UB[0:8]

WE: U[0:8], UB[0:8]

A[0:11]: U[0:8], UB[0:8]

DQ[16:23]

DQ[0:7]

DQ[48:55]

DQ[0:7]

CAS

A[0:11]

UB3

UB7

DQMB3

DQM

DQMB7

DQM

DQ[24:31]

DQ[0:7]

DQ[56:63]

DQ[0:7]

SPD EEPROM

SDA

SCL

LEGEND: CS

Chip select

SPD = Serial Presence Detect

47 kΩ

SA0 SA1 SA2

†

Additional 3.3 pF capacity is used to balance loads among clocks.

POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443

1...5 6 789 10 11...22

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