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TLV5619IDWR

更新时间： 2024-11-02 13:14:51
品牌 Logo 应用领域
德州仪器 - TI 转换器
页数 文件大小 规格书
18页 253K
描述
12-Bit, Single Channel DAC, Parallel, Voltage Out, Low Power, Asynchronous Update 20-SOIC -40 to 85

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TLV5619IDWR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP20,.4针数：20
Reach Compliance Code：compliantFactory Lead Time：6 weeks
风险等级：5.11最大模拟输出电压：2.9 V
最小模拟输出电压：转换器类型：D/A CONVERTER
输入位码：BINARY输入格式：PARALLEL, WORD
JESD-30 代码：R-PDSO-G20JESD-609代码：e4
长度：12.8 mm最大线性误差 (EL)：0.0977%
湿度敏感等级：1位数：12
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP20,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
电源：3/5 V认证状态：Not Qualified
采样速率：1 MHz座面最大高度：2.65 mm
最大稳定时间：3 µs标称安定时间 (tstl)：1 µs
子类别：Other Converters最大压摆率：3 mA
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.5 mm
Base Number Matches：1

TLV5619IDWR 数据手册

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TLV5619  
2.7 V TO 5.5 V 12-BIT PARALLEL DIGITAL-TO-ANALOG CONVERTER  
WITH POWER DOWN  
SLAS172C – DECEMBER 1997 – REVISED APRIL 2000  
Single Supply 2.7-V to 5.5-V Operation  
applications  
±0.4 LSB Differential Nonlinearity (DNL),  
±1.5 LSB Integral Nonlinearity (INL)  
Battery Powered Test Instruments  
Digital Offset and Gain Adjustment  
12-Bit Parallel Interface  
Compatible With TMS320 DSP  
Internal Power On Reset  
Settling Time 1 µs Typ  
Battery Operated/Remote Industrial  
Controls  
Machine and Motion Control Devices  
Cordless and Wireless Telephones  
Speech Synthesis  
Low Power Consumption:  
– 8 mW for 5-V Supply  
– 4.3 mW for 3-V Supply  
Communication Modulators  
Arbitrary Waveform Generation  
Reference Input Buffers  
Voltage Output  
DW OR PW PACKAGE  
(TOP VIEW)  
Monotonic Over Temperature  
Asynchronous Update  
1
2
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10  
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19  
18  
17  
16  
15  
14  
13  
12  
11  
D2  
D3  
D4  
D5  
D6  
D7  
D8  
D9  
D10  
D11  
D1  
D0  
CS  
WE  
LDAC  
PD  
GND  
OUT  
REFIN  
description  
The TLV5619 is a 12-bit voltage output DAC with  
a microprocessor and TMS320 compatible  
parallel interface. The 12 data bits are double  
buffered so that the output can be updated  
asynchronously using the LDAC pin. During  
normal operation, the device dissipates 8 mW at  
a 5-V supply and 4.3 mW at a 3-V supply. The  
power consumption can be lowered to 50 nW by  
setting the DAC to power-down mode.  
V
DD  
The output voltage is buffered by a ×2 gain  
rail-to-rail amplifier, which features a Class A  
output stage to improve stability and reduce  
settling time.  
AVAILABLE OPTIONS  
PACKAGE  
SMALL OUTLINE  
(DW)  
TSSOP  
(PW)  
T
A
0°C to 70°C  
–40°C to 85°C  
–40°C to 125°C  
TLV5619CDW  
TLV5619IDW  
TLV5619QDW  
TLV5619CPW  
TLV5619IPW  
—
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2000, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...18

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