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SNJ54LVTH543JT

更新时间： 2024-11-03 23:03:19
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德州仪器 - TI 输出元件
页数 文件大小 规格书
14页 350K
描述
3.3 V ABT OCTAL REGISTERED TRANSCEIVERS WITH 3 STATE OUTPUTS

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SNJ54LVTH543JT 技术参数

生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP24,.3针数：24
Reach Compliance Code：unknown风险等级：5.84
其他特性：WITH INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION控制类型：INDEPENDENT CONTROL
计数方向：BIDIRECTIONAL系列：LVT
JESD-30 代码：R-GDIP-T24长度：32.005 mm
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER最大I（ol）：0.048 A
位数：8功能数量：1
端口数量：2端子数量：24
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DIP
封装等效代码：DIP24,.3封装形状：RECTANGULAR
封装形式：IN-LINE包装方法：TUBE
电源：3.3 VProp。Delay @ Nom-Sup：3.9 ns
传播延迟（tpd）：6.1 ns认证状态：Not Qualified
筛选级别：MIL-PRF-38535座面最大高度：5.08 mm
子类别：Bus Driver/Transceivers最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：2.7 V标称供电电压 (Vsup)：3.3 V
表面贴装：NO技术：BICMOS
温度等级：MILITARY端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
翻译：N/A宽度：7.62 mm
Base Number Matches：1

SNJ54LVTH543JT 数据手册

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SCBS704F − AUGUST 1997 − REVISED OCTOBER 2003  
D
Support Mixed-Mode Signal Operation  
(5-V Input and Output Voltages With  
D
Bus Hold on Data Inputs Eliminates the  
Need for External Pullup/Pulldown  
Resistors  
3.3-V V  
)
CC  
D
D
D
Typical V  
<0.8 V at V  
(Output Ground Bounce)  
D
D
Latch-Up Performance Exceeds 500 mA Per  
JESD 17  
OLP  
CC  
= 3.3 V, T = 25°C  
A
Support Unregulated Battery Operation  
Down to 2.7 V  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
I
and Power-Up 3-State Support Hot  
off  
Insertion  
SN54LVTH543 . . . FK PACKAGE  
(TOP VIEW)  
SN54LVTH543 . . . JT OR W PACKAGE  
SN74LVTH543 . . . DB, DGV, DW, NS, OR PW PACKAGE  
(TOP VIEW)  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
LEBA  
OEBA  
A1  
V
CC  
CEBA  
2
4
3
2
1 28 27 26  
25  
3
B1  
B2  
B3  
B4  
B5  
B6  
B7  
B8  
A2  
A3  
A4  
NC  
A5  
A6  
A7  
B2  
B3  
B4  
5
6
7
8
9
4
A2  
A3  
A4  
A5  
A6  
A7  
A8  
24  
23  
5
6
22 NC  
21 B5  
20 B6  
19 B7  
7
8
10  
11  
9
10  
11  
12  
12 13 14 15 16 17 18  
CEAB  
GND  
LEAB  
OEAB  
NC − No internal connection  
description/ordering information  
These octal transceivers are designed specifically for low-voltage (3.3-V) V  
to provide a TTL interface to a 5-V system environment.  
operation, but with the capability  
CC  
ORDERING INFORMATION  
ORDERABLE  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PART NUMBER  
SN74LVTH543DW  
SN74LVTH543DWR  
SN74LVTH543NSR  
SN74LVTH543DBR  
SN74LVTH543PW  
SN74LVTH543PWR  
SN74LVTH543DGVR  
SNJ54LVTH543JT  
SNJ54LVTH543W  
SNJ54LVTH543FK  
Tube  
SOIC − DW  
LVTH543  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SOP − NS  
LVTH543  
LXH543  
SSOP − DB  
−40°C to 85°C  
−55°C to 125°C  
TSSOP − PW  
LXH543  
Tape and reel  
Tape and reel  
Tube  
TVSOP − DGV  
CDIP − JT  
LXH543  
SNJ54LVTH543JT  
SNJ54LVTH543W  
SNJ54LVTH543FK  
CFP − W  
Tube  
LCCC − FK  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines  
are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2003, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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与SNJ54LVTH543JT相关器件

型号 品牌 获取价格 描述 数据表
SNJ54LVTH543W TI

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