5秒后页面跳转
捷配首页

Datasheet > SN74F573DWRG4
SN74F573DWRG4 PDF预览

SN74F573DWRG4

更新时间： 2024-11-29 15:52:11
品牌 Logo 应用领域
罗彻斯特 - ROCHESTER 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
5页 82K
描述
Bus Driver, F/FAST Series, 1-Func, 8-Bit, True Output, TTL, PDSO20, PLASTIC, DSO-20

阅读下载

中文翻译

获取价格

SN74F573DWRG4 技术参数

生命周期：Contact Manufacturer包装说明：PLASTIC, DSO-20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.68Is Samacsys：N
其他特性：BROADSIDE VERSION OF 373系列：F/FAST
JESD-30 代码：R-PDSO-G20长度：12.8 mm
逻辑集成电路类型：BUS DRIVER位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：70 °C
最低工作温度：输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE传播延迟（tpd）：8 ns
座面最大高度：2.65 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：TTL
温度等级：COMMERCIAL端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：7.5 mmBase Number Matches：1

SN74F573DWRG4 数据手册

 浏览型号SN74F573DWRG4的Datasheet PDF文件第2页浏览型号SN74F573DWRG4的Datasheet PDF文件第3页浏览型号SN74F573DWRG4的Datasheet PDF文件第4页浏览型号SN74F573DWRG4的Datasheet PDF文件第5页 
ꢀ
ꢁ
ꢂ
ꢃ
ꢄ
ꢂ
ꢅ
ꢆ
ꢇ
ꢈ
ꢉ ꢊꢋꢌꢍꢈꢋ ꢎꢌ ꢁꢀꢏꢌꢎꢐ ꢁꢋ ꢈꢑꢒꢋ ꢓꢏ ꢐꢈ ꢍꢌꢋꢊ ꢔ ꢐ  
ꢀ
ꢁ
ꢅ
ꢃ
ꢄ
ꢂ
ꢅ
ꢆ
ꢀ
ꢀ
ꢕ
ꢖ
ꢋ
ꢔ
ꢈ
ꢆ
ꢒ
ꢀ
ꢋ
ꢌ
ꢋ
ꢐ
ꢈ
ꢉ
ꢗ
ꢋ
ꢏ
ꢗ
ꢋ
SDFS011A − MARCH 1987 − REVISED OCTOBER 1993  
SN54F573 . . . J PACKAGE  
SN74F573 . . . DW OR N PACKAGE  
(TOP VIEW)  
• Eight Latches in a Single Package  
• 3-State Bus-Driving True Outputs  
• Full Parallel Access for Loading  
• Buffered Control Inputs  
OE  
1D  
2D  
3D  
4D  
5D  
6D  
7D  
8D  
V
CC  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
17  
16  
15  
14  
1Q  
2Q  
3Q  
4Q  
5Q  
6Q  
• Package Options Include Plastic  
Small-Outline Packages, Ceramic Chip  
Carriers, and Standard Plastic and Ceramic  
300-mil DIPs  
description  
13 7Q  
12 8Q  
These 8-bit latches feature 3-state outputs  
designed specifically for driving highly capacitive  
or relatively low-impedance loads. They are  
particularly suitable for implementing buffer  
registers, I/O ports, bidirectional bus drivers, and  
working registers.  
11  
GND  
LE  
SN54F573 . . . FK PACKAGE  
(TOP VIEW)  
The eight latches of the ′F573 are transparent  
D-type latches. While the latch enable (LE) input  
is high, the Q outputs follow the data (D) inputs.  
When the latch enable is taken low, the Q outputs  
are latched at the logic levels set up at the D  
inputs.  
3
2
1
20 19  
18  
4
5
6
7
8
3D  
4D  
5D  
6D  
7D  
2Q  
3Q  
4Q  
5Q  
6Q  
17  
16  
15  
14  
A buffered output enable (OE) input can be used  
to place the eight outputs in either a normal logic  
state (high or low logic levels) or a high-  
impedance state. In the high-impedance state, the  
outputs neither load nor drive the bus lines  
significantly. The high-impedance state and  
increased drive provide the capability to drive bus  
lines without need for interface or pullup  
components.  
9 10 11 12 13  
The output enable (OE) input does not affect the internal operations of the latches. Old data can be retained  
or new data can be entered while the outputs are in the high-impedance state.  
The SN54F573 is characterized for operation over the full military temperature range of −55°C to 125°C. The  
SN74F573 is characterized for operation from 0°C to 70°C.  
FUNCTION TABLE  
(each latch)  
INPUTS  
OUTPUT  
Q
OE  
L
LE  
H
H
L
D
H
L
H
L
L
L
X
X
Q
0
H
X
Z
ꢏ
ꢏ
ꢎ
ꢉ
ꢧ
ꢑ
ꢢ
ꢗ
ꢊ
ꢠ
ꢋ
ꢡ
ꢖ
ꢛ
ꢉ
ꢙ
ꢁ
ꢚ
ꢑ
ꢌ
ꢋ
ꢌ
ꢘ
ꢙ
ꢣ
ꢚ
ꢛ
ꢡ
ꢜ
ꢝ
ꢞ
ꢞ
ꢟ
ꢟ
ꢘ
ꢘ
ꢛ
ꢛ
ꢙ
ꢙ
ꢘ
ꢠ
ꢠ
ꢤ
ꢡ
ꢢ
ꢜ
ꢜ
ꢣ
ꢣ
ꢙ
ꢟ
ꢞ
ꢝ
ꢠ
ꢠ
ꢛ
ꢚ
ꢤ
ꢋꢣ  
ꢢ
ꢥ
ꢠ
ꢦ
ꢘ
ꢡ
ꢞ
ꢠ
ꢟ
ꢘ
ꢟ
ꢛ
ꢜ
ꢙ
ꢢ
ꢧ
ꢞ
ꢙ
ꢟ
ꢟ
ꢣ
ꢠ
ꢨ
Copyright 1993, Texas Instruments Incorporated  
ꢜ
ꢛ
ꢡ
ꢟ
ꢛ
ꢜ
ꢝ
ꢟ
ꢛ
ꢠ
ꢤ
ꢘ
ꢚ
ꢘ
ꢡ
ꢣ
ꢜ
ꢟ
ꢩ
ꢟ
ꢣ
ꢜ
ꢛ
ꢚ
ꢪ
ꢞ
ꢖ
ꢙ
ꢝ
ꢣ
ꢠ
ꢟ
ꢞ
ꢙ
ꢧ
ꢞ
ꢜ
ꢧ
ꢫ
ꢞ
ꢟ ꢣ ꢠ ꢟꢘ ꢙꢭ ꢛꢚ ꢞ ꢦꢦ ꢤꢞ ꢜ ꢞ ꢝ ꢣ ꢟ ꢣ ꢜ ꢠ ꢨ  
ꢜ
ꢜ
ꢞ
ꢙ
ꢟ
ꢬ
ꢨ
ꢏ
ꢜ
ꢛ
ꢧ
ꢢ
ꢡ
ꢟ
ꢘ
ꢛ
ꢙ
ꢤ
ꢜ
ꢛ
ꢡ
ꢣ
ꢠ
ꢠ
ꢘ
ꢙ
ꢭ
ꢧ
ꢛ
ꢣ
ꢠ
ꢙ
ꢛ
ꢟ
ꢙ
ꢣ
ꢡ
ꢣ
ꢠ
ꢠ
ꢞ
ꢜ
ꢘ
ꢦ
ꢬ
ꢘ
ꢙ
ꢡ
ꢦ
ꢢ
ꢧ
ꢣ
2−1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
12345

中文翻译

下载PDF

与SN74F573DWRG4相关器件

型号 品牌 获取价格 描述 数据表
SN74F573N TI

获取价格

 		OCTAL TRANSPARENT D-TYPE LATCHES WITH 3-STATE OUTPUTS
SN74F573N-10 TI

获取价格

 		F/FAST SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDIP20
SN74F573NE4 TI

获取价格

 		Octal Transparent D-Type Latches With 3-State Outputs 20-PDIP 0 to 70
SN74F574 TI

获取价格

 		OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOP WITH 3-STATE OUTPUTS
SN74F574DW TI

获取价格

 		OCTAL EDGE-TRIGGERED D-TYPE FLIP-FLOP WITH 3-STATE OUTPUTS
SN74F574DW-00R TI

获取价格

 		F/FAST SERIES, 8-BIT DRIVER, TRUE OUTPUT, PDSO20
SN74F574DWE4 TI

获取价格

 		Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SOIC 0 to 70
SN74F574DWG4 TI

获取价格

 		Octal Edge-Triggered D-Type Flip-Flops With 3-State Outputs 20-SOIC 0 to 70
SN74F574DWR TI

获取价格

 		暂无描述
SN74F574DWRE4 TI

获取价格

 		Eight D-Type Flip-Flops in a Single Package

与SN74F573DWRG4相关文章

您还可以找


热门产品
PCB打样/小批量
铝基板
BOM智能配单
PCBA制造
钣金
精密CNC
模具注塑
薄膜开关
精选活动
PCBA打样特惠
四六层板品质升级
铝基板品质升级
一体化电子制造
DFM下载
服务支持
企业认证
产品展示
工厂展示
工艺能力
积分商城
关于捷配
捷配简介
企业文化
公司动态
人才招聘
联系我们
帮助中心
下单流程
付款流程
开票流程
常见问题
全球PCB制造服务专线 400-613-0088

工作时间：9:00-21:00

CEO邮箱：ceo@jiepei.com

投诉邮箱：tousu@jiepei.com

捷配网-微信公众号 微信公众号
捷配网-微信公众号 抖音公众号
资质认证：
合作快递：
支付方式：
Copyright © 2024 Jiepei.com Inc. All Rights Reserved. 版权所有:杭州捷配信息科技有限公司 浙公网安备 33010502006866号 浙ICP备10014259号-119 营业执照ICP证