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Datasheet > 逻辑 > 移位寄存器> SN74ALS166DBRG4
SN74ALS166DBRG4 PDF预览

SN74ALS166DBRG4

更新时间： 2024-11-09 05:24:55
品牌 Logo 应用领域
德州仪器 - TI 移位寄存器触发器逻辑集成电路光电二极管
页数 文件大小 规格书
15页 506K
描述
PARALLEL-LOAD 8-BIT SHIFT REGISTER

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SN74ALS166DBRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SSOP, SSOP16,.3针数：16
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.59Is Samacsys：N
其他特性：SISO OPERATION ALSO AVAILABLE计数方向：RIGHT
系列：ALSJESD-30 代码：R-PDSO-G16
JESD-609代码：e4长度：6.2 mm
逻辑集成电路类型：PARALLEL IN SERIAL OUT湿度敏感等级：1
位数：8功能数量：1
端子数量：16最高工作温度：70 °C
最低工作温度：输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP16,.3封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
电源：5 V传播延迟（tpd）：13 ns
认证状态：Not Qualified座面最大高度：2 mm
子类别：Shift Registers最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：TTL
温度等级：COMMERCIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：5.3 mm
最小 fmax：45 MHzBase Number Matches：1

SN74ALS166DBRG4 数据手册

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SN74ALS166  
PARALLEL-LOAD 8-BIT SHIFT REGISTER  
SDAS156D – APRIL 1982 – REVISED AUGUST 2000  
D, DB, OR N PACKAGE  
(TOP VIEW)  
Synchronous Load  
Direct Overriding Clear  
Parallel-to-Serial Conversion  
SER  
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
A
SH/LD  
Package Options Include Plastic  
Small-Outline (D) and Shrink Small-Outline  
(DB) Packages and Standard Plastic (N) DIP  
B
C
H
Q
H
D
G
description  
CLK INH  
CLK  
F
E
The SN74ALS166 parallel-load 8-bit shift register  
is compatible with most other TTL logic families.  
All inputs are buffered to lower the drive  
requirements. Input clamping diodes minimize  
switching transients and simplify system design.  
GND  
CLR  
These parallel-in or serial-in, serial-out registers have a complexity of 77 equivalent gates on the chip. They  
feature gated clocks (CLK and CLK INH) inputs and an overriding clear (CLR) input. The parallel-in or serial-in  
modes are established by the shift/load (SH/LD) input. When high, SH/LD enables the serial data (SER) input  
and couples the eight flip-flops for serial shifting with each clock pulse. When low, the parallel (broadside) data  
(A–H)inputsareenabledandsynchronousloadingoccursonthenextclockpulse. Duringparallelloading, serial  
data flow is inhibited. Clocking is accomplished on the low-to-high-level edge of the clock pulse through a  
two-input positive-NOR gate, permitting one input to be used as a clock-enable or clock-inhibit function. Holding  
either of the clock inputs high inhibits clocking; holding either low enables the other clock input. This allows the  
system clock to be free running and the register can be stopped on command with the clock input. CLK INH  
shouldbechangedtothehighlevelonlywhenCLKishigh. ThebufferedCLRoverridesallotherinputs, including  
CLK, and sets all flip-flops to zero.  
The SN74ALS166 is characterized for operation from 0°C to 70°C.  
FUNCTION TABLE  
INPUTS  
INTERNAL  
OUTPUTS  
OUTPUT  
PARALLEL  
Q
CLR  
SH/LD  
CLK  
CLK INH  
SER  
H
A . . . H  
Q
Q
B
A
L
X
X
L
X
L
L
L
L
H
X
L
↑
↑
↑
↑
X
X
X
H
L
X
L
L
L
H
H
H
H
H
X
Q
Q
Q
H0  
h
A0  
B0  
a . . . h  
a
H
L
b
H
H
X
X
X
X
Q
Q
Gn  
Q
Gn  
Q
H0  
An  
An  
B0  
Q
Q
X
Q
A0  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2000, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...15

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SN74ALS166DBRG4 替代型号

型号 品牌 替代类型 描述 数据表
SN74ALS166DBRE4 TI

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 PARALLEL-LOAD 8-BIT SHIFT REGISTER
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完全替代

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型号 品牌 获取价格 描述 数据表
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 		IC IC,SHIFT REGISTER,ALS-TTL,LDCC,20PIN,PLASTIC, Shift Register
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