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SN74ACQ573SJX PDF预览

SN74ACQ573SJX

更新时间： 2024-11-05 14:44:51
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
10页 212K
描述
Bus Driver, AC Series, 1-Func, 8-Bit, True Output, CMOS, PDSO20, EIAJ TYPE2, PLASTIC, SSOP-20

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SN74ACQ573SJX 技术参数

生命周期：Obsolete零件包装代码：SSOP
包装说明：SOP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.63Is Samacsys：N
系列：ACJESD-30 代码：R-PDSO-G20
长度：12.6 mm逻辑集成电路类型：BUS DRIVER
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
传播延迟（tpd）：8.5 ns认证状态：Not Qualified
座面最大高度：2.1 mm最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
宽度：5.3 mmBase Number Matches：1

SN74ACQ573SJX 数据手册

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May 1998  
74ACQ573 • 74ACTQ573  
™
Quiet Series Octal Latch with 3-STATE Outputs  
General Description  
Features  
n ICC and IOZ reduced by 50%  
The ACQ/ACTQ573 is a high-speed octal latch with buffered  
common Latch Enable (LE) and buffered common Output  
Enable (OE) inputs. The ACQ/ACTQ573 is functionally iden-  
tical to the ACQ/ACTQ373 but with inputs and outputs on op-  
posite sides of the package. The ACQ/ACTQ utilizes Fair-  
n Guaranteed simultaneous switching noise level and  
dynamic threshold performance  
n Guaranteed pin-to-pin skew AC performance  
n Improved latch-up immunity  
n Inputs and outputs on opposite sides of package allow  
easy interface with microprocessors  
n Outputs source/sink 24 mA  
™
child’s Quiet Series technology to guarantee quiet output  
switching and improved dynamic threshold performance.  
™
™
FACT Quiet Series features GTO output control and un-  
dershoot corrector in addition to a split ground bus for supe-  
rior performance.  
n Faster prop delays than standard AC/ACT573  
n 4 kV minimum ESD immunity  
Ordering Code:  
Order Number  
74ACQ573SC  
74ACQ573SJ  
Package Number  
M20B  
Package Description  
20-Lead (0.300" Wide) Molded Small Outline Package  
M20D  
20-Lead (0.300" Wide) Molded Shrink Small Outline Package EIAJ  
20-Lead Molded Dual-in-Line Package  
74ACQ573PC  
74ACTQ573SC  
74ACTQ573SJ  
74ACTQ573PC  
74ACTQ573QSC  
V20A  
M20B  
20-Lead (0.300" Wide) Molded Small Outline Package  
20-Lead (0.300" Wide) Molded Shrink Small Outline Package EIAJ  
20-Lead Molded Dual-in-Line Package  
M20D  
V20A  
MQA20  
20-Lead (0.150" Wide) Molded Shrink Small Outline Package  
Device also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.  
Logic Symbols  
Connection Diagram  
Pin Assignment for DIP  
QSOP and SOIC  
DS010633-1  
IEEE/IEC  
DS010633-3  
Pin Descriptions  
Pin Names  
Description  
D0–D7  
Data Inputs  
LE  
Latch Enable Input  
OE  
3-STATE Output Enable Input  
3-STATE Latch Outputs  
DS010633-2  
O0–O7  
™
™
™
™
FACT , Quiet Series , FACT Quiet Series , and GTO are trademarks of Fairchild Semiconductor Corporation  
© 1998 Fairchild Semiconductor Corporation  
DS010633  
www.fairchildsemi.com  
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