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QL12X16B-1CG84M/883C

更新时间： 2024-02-13 17:37:52

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其他 - ETC		现场可编程门阵列可编程逻辑栅时钟
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描述
Field Programmable Gate Array (FPGA)

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QL12X16B-1CG84M/883C 技术参数

生命周期：	Obsolete	零件包装代码：	PGA
包装说明：	PGA,	针数：	84
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.2.C
HTS代码：	8542.39.00.01	风险等级：	5.83
其他特性：	MAX 68 I/OS	CLB-Max的组合延迟：	8.112 ns
JESD-30 代码：	S-CPGA-P84	长度：	27.94 mm
可配置逻辑块数量：	192	等效关口数量：	2000
端子数量：	84	最高工作温度：	125 °C
最低工作温度：	-55 °C	组织：	192 CLBS, 2000 GATES
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	PGA
封装形状：	SQUARE	封装形式：	GRID ARRAY
可编程逻辑类型：	FIELD PROGRAMMABLE GATE ARRAY	认证状态：	Not Qualified
座面最大高度：	4.1656 mm	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	MILITARY	端子形式：	PIN/PEG
端子节距：	2.54 mm	端子位置：	PERPENDICULAR
宽度：	27.94 mm	Base Number Matches：	1

QL12X16B-1CG84M/883C 数据手册

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QL12X16B

pASIC^®1 Family

Very-High-Speed CMOS FPGA

Rev C

pASIC

HIGHLIGHTS

Very High Speed – ViaLink metal-to-metal programmable–via

antifuse technology, allows counter speeds over 150 MHz and logic

cell delays of under 2 ns.

High Usable Density

–

A 12-by-16 array of 192 logic cells

provides 2,000 usable ASIC gates (4,000 PLD gates) in 68-pin and

84-pin PLCC, 84-pin CPGA and 100-pin TQFP packages.

…2,000

usable ASIC gates,

88 I/O pins

Low-Power, High-Output Drive

– Standby current typically 2

mA. A 16-bit counter operating at 100 MHz consumes less than 50

mA. Minimum IOL of 12 mA and IOH of 8 mA

Low-Cost, Easy-to-Use Design Tools

–

Designs entered and

simulated using QuickLogic's new QuickWorks development

environment, or with third-party CAE tools including Viewlogic,

Synopsys, Mentor, Cadence and Veribest. Fast, fully automatic place

and route on PC and workstation platforms using QuickLogic

software.

QL12x16B

Block Diagram

192 Logic Cells

Up to 80 prog. I/O cells, 6 Input high-drive cells, 2 Input/Clk (high-drive) cells

4-13

12 3 4 5 6 7 8

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