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PLL130-05QI

更新时间： 2024-02-29 03:30:14

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PLL		转换器
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4页	208K
描述
High Speed Translator Buffer to PECL (Enable Low)

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PLL130-05QI 技术参数

生命周期：	Active	包装说明：	HVQCCN, LCC16,.12SQ,20
Reach Compliance Code：	compliant	风险等级：	5.49
Is Samacsys：	N	其他特性：	IT ALSO OPERATES AT 3.3 V
接口集成电路类型：	TTL/CMOS TO PECL TRANSLATOR	JESD-30 代码：	S-XQCC-N16
长度：	3 mm	位数：	1
功能数量：	1	端子数量：	16
最高工作温度：	70 °C	最低工作温度：
输出极性：	COMPLEMENTARY	封装主体材料：	UNSPECIFIED
封装代码：	HVQCCN	封装等效代码：	LCC16,.12SQ,20
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
座面最大高度：	0.8 mm	标称供电电压：	2.5 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	3 mm
Base Number Matches：	1

PLL130-05QI 数据手册

PLL130-05

High Speed Translator Buffer to PECL (Enable Low)

FEATURES

PIN CONFIGURATION

(TOP VIEW)

•

Differential PECL output

Single AC coupled input (min. 100mV swing).

Input range from DC to 1.0 GHz.

2.5V to 3.3V operation.

Available in 3x3mm QFN.

GND

PECL_BAR

VDD

¹⁴PLL130-05

GND

PECL

OE^V

GND

DESCRIPTION

The PLL130-05 is a low cost, high performance,

high speed, buffer that reproduces any input fre-

quency from DC to 1.3GHz. It provides one pair

of differential PECL outputs. Any input signal

with at least 100mV swing can be used as refer-

ence signal. This chip is ideal for conversion

from sine wave, TTL, CMOS, or LVDS to PECL.

Note: denotes internal pull down

BLOCK DIAGRAM

PECL_BAR

PECL

Input

Amplifier

REF_IN

47745 Fremont Blvd., Fremont, California 94538 Tel (510) 492-0990 Fax (510) 492-0991 www.phaselink.com Rev 09/09/04 Page 1

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型号	品牌	描述	获取价格	数据表
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