PALCE20V8L-15PI

更新时间： 2024-11-09 22:16:31

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赛普拉斯 - CYPRESS		闪存
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描述
Flash Erasable, Reprogrammable CMOS PAL Device

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PALCE20V8L-15PI 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP, DIP24,.3	针数：	24
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.84	其他特性：	8 MACROCELLS; 1 EXTERNAL CLOCK; SHARED INPUT/CLOCK
架构：	PAL-TYPE	最大时钟频率：	45.5 MHz
JESD-30 代码：	R-PDIP-T24	长度：	31.75 mm
专用输入次数：	12	I/O 线路数量：	8
输入次数：	20	输出次数：	8
产品条款数：	64	端子数量：	24
最高工作温度：	85 °C	最低工作温度：	-40 °C
组织：	12 DEDICATED INPUTS, 8 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP24,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	5 V
可编程逻辑类型：	FLASH PLD	传播延迟：	15 ns
认证状态：	Not Qualified	座面最大高度：	4.826 mm
子类别：	Programmable Logic Devices	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	INDUSTRIAL	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
宽度：	7.62 mm

PALCE20V8L-15PI 数据手册

20V8

PALCE20V8

Flash Erasable,

Reprogrammable CMOS PAL Device

• QSOP package available

Features

— 10, 15, and 25 ns com’l version

—15, and 25 ns military/industrial versions

• High reliability

• Active pull-up on data input pins

• Low power version (20V8L)

— 55 mA max. commercial (15, 25 ns)

—Proven Flash technology

— 65 mA max. military/industrial

(15, 25 ns)

—100% programming and functional testing

• Standard version has low power

Functional Description

— 90 mA max. commercial

(15, 25 ns)

The Cypress PALCE20V8 is a CMOS Flash Erasable sec-

ond-generation programmable array logic device. It is imple-

mented with the familiar sum-of-product (AND-OR) logic struc-

ture and the programmable macrocell.

— 115 mA max. commercial (10 ns)

— 130 mA max. military/industrial (15, 25 ns)

• CMOS Flash technology for electrical erasability and

reprogrammability

• User-programmable macrocell

— Output polarity control

The PALCE20V8 is executed in a 24-pin 300-mil molded DIP,

a 300-mil cerdip, a 28-lead square ceramic leadless chip car-

rier, a 28-lead square plastic leaded chip carrier, and a 24-lead

quarter size outline. The device provides up to 20 inputs and

8 outputs. The PALCE20V8 can be electrically erased and re-

programmed. The programmable macrocell enables the de-

vice to function as a superset to the familiar 24-pin PLDs such

as 20L8, 20R8, 20R6, 20R4.

— Individually selectable for registered or combinato-

rial operation

Logic Block Diagram (PDIP/CDIP/QSOP)

GND

CLK/I

PROGRAMMABLE

AND ARRAY

(64 x 40)

MUX

Macrocell

MUX

OE/I

I/O

20V8–1

PAL is a registered trademark of Advanced Micro Devices, Inc.

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-03026 Rev. **

Revised March 26, 1997

12 3 4 5 6 7...14

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