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NL17SHT04P5T5G

更新时间： 2024-02-13 19:29:18
品牌 Logo 应用领域
安森美 - ONSEMI 栅光电二极管逻辑集成电路触发器
页数 文件大小 规格书
5页 103K
描述
Inverting Buffer CMOS Logic Level Shifter

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NL17SHT04P5T5G 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOT
包装说明：LEAD FREE, SOT-953, 5 PIN针数：5
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：16 weeks风险等级：5.74
系列：17SHJESD-30 代码：R-PDSO-F5
JESD-609代码：e3长度：1 mm
负载电容（CL）：50 pF逻辑集成电路类型：INVERTER
最大I（ol）：0.004 A湿度敏感等级：1
功能数量：1输入次数：1
端子数量：5最高工作温度：125 °C
最低工作温度：-55 °C封装主体材料：PLASTIC/EPOXY
封装代码：VSOF封装等效代码：FL6,.03,14
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, VERY THIN PROFILE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3/5 VProp。Delay @ Nom-Sup：17.5 ns
传播延迟（tpd）：17.5 ns认证状态：Not Qualified
施密特触发器：NO座面最大高度：0.4 mm
子类别：Gates最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Tin (Sn)
端子形式：FLAT端子节距：0.35 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：0.8 mmBase Number Matches：1

NL17SHT04P5T5G 数据手册

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NL17SHT04  
Inverting Buffer /  
CMOS Logic Level Shifter  
LSTTL−Compatible Inputs  
The NL17SHT04 is a single gate inverting buffer fabricated with  
silicon gate CMOS technology. It achieves high speed operation  
similar to equivalent Bipolar Schottky TTL while maintaining CMOS  
low power dissipation.  
http://onsemi.com  
MARKING  
DIAGRAM  
The internal circuit is composed of three stages, including a buffer  
output which provides high noise immunity and stable output.  
The device input is compatible with TTL−type input thresholds and  
the output has a full 5 V CMOS level output swing. The input protection  
circuitry on this device allows overvoltage tolerance on the input,  
allowing the device to be used as a logic−level translator from 3 V  
CMOS logic to 5 V CMOS Logic or from 1.8 V CMOS logic to 3 V  
CMOS Logic while operating at the high−voltage power supply.  
The NL17SHT04 input structure provides protection when voltages  
up to 7.0 V are applied, regardless of the supply voltage. This allows  
the NL17SHT04 to be used to interface 5 V circuits to 3 V circuits.  
SOT−953  
CASE 527AE  
LM  
1
L
M
= Specific Device Code  
= Month Code  
PIN ASSIGNMENT  
1
2
3
4
5
IN A  
GND  
NC  
The output structures also provide protection when V = 0 V. These  
CC  
input and output structures help prevent device destruction caused by  
supply voltage − input/output voltage mismatch, battery backup, hot  
insertion, etc.  
OUT Y  
Features  
V
CC  
• High Speed: t = 3.8 ns (Typ) at V = 5 V  
PD  
CC  
• Low Power Dissipation: I = 1 mA (Max) at T = 25°C  
CC  
A
FUNCTION TABLE  
• TTL−Compatible Inputs: V = 0.8 V; V = 2 V  
IL  
IH  
• CMOS−Compatible Outputs: V > 0.8 V ; V < 0.1 V @ Load  
A Input  
Y Output  
OH  
CC OL  
CC  
• Power Down Protection Provided on Inputs and Outputs  
• Balanced Propagation Delays  
L
H
L
H
• Pin and Function Compatible with Other Standard Logic Families  
• These are Pb−Free Devices  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 4 of this data sheet.  
1
2
3
5
IN A  
GND  
NC  
V
CC  
4
OUT Y  
Figure 1. Pinout (Top View)  
1
IN A  
OUT Y  
Figure 2. Logic Symbol  
© Semiconductor Components Industries, LLC, 2011  
1
Publication Order Number:  
August, 2011 − Rev. 0  
NL17SHT04/D  
12345

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