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MT89L85ANR

更新时间： 2024-01-04 16:35:58
品牌 Logo 应用领域
美高森美 - MICROSEMI 光电二极管
页数 文件大小 规格书
25页 592K
描述
Telecom IC, CMOS, PDSO48

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MT89L85ANR 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SSOP
针数：48Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.68
JESD-30 代码：R-PDSO-G48端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP48,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH电源：3.3 V
认证状态：Not Qualified子类别：Other Telecom ICs
最大压摆率：7 mA标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：0.635 mm端子位置：DUAL
Base Number Matches：1

MT89L85ANR 数据手册

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MT89L85  
Data Sheet  
1
48  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
CSTo  
ODE  
STo0  
STo1  
STo2  
NC  
VSS  
DTA  
STi0  
STi1  
STi2  
NC  
STi3  
STi4  
STi5  
STi6  
STi7  
VDD  
2
3
4
5
6
7
STo3  
STo4  
8
9
STo5  
STo6  
STo7  
VSS  
VDD  
D0  
STi3  
STi4  
STi5  
STi6  
7
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
STo3  
STo4  
STo5  
STo6  
STo7  
VSS  
D0  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
8
9
10  
11  
12  
13  
14  
15  
16  
17  
STi7  
RESET  
VDD  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
F0i  
C4i  
A0  
A1  
F0i  
C4i  
A0  
A1  
A2  
D1  
D1  
D2  
D2  
D3  
D3  
D4  
A2  
D4  
NC  
NC  
D5  
A3  
A4  
D6  
D7  
A5  
CS  
DS  
44 PIN PLCC  
VSS  
25  
R/W  
48 PIN SSOP  
(JEDEC MO-118, 300mil Wide)  
Figure 2 - Pin Connections  
Pin Description  
Pin #  
44  
Name  
Description  
48 SSOP  
PLCC  
2
2
DTA Data Acknowledgment (Open Drain Output). This active low output indicates that a data  
bus transfer is complete. A pull-up resistor is required at this output.  
3-5  
3-5  
STi0- ST-BUS Input 0 to 7 (Inputs). Serial data input streams. These streams have 32 channels at  
7-11  
7-11  
STi7 data rates of 2.048 Mbit/s.  
12  
12,36  
13  
VDD +3.3 Volt Power Supply.  
RESET Device Reset (5V tolerant input). This pin is only available for the 48-pin SSOP package.  
This active low input puts the MT89L85 in its reset state. It clears the internal counters and  
registers. All ST-BUS outputs are set to the high impedance state. This RESET pin must be  
held low for a minimum of 100nsec to reset the device.  
13  
14  
14  
15  
F0i Frame Pulse (Input). This input accepts and automatically identifies frame synchronization  
signals formatted according to different backplane specifications such as ST-BUS and GCI.  
C4i Clock (Input). 4.096 MHz serial clock for shifting data in and out of the data streams.  
15-17  
19-21  
16-18 A0-A5 Address 0 to 5 (Inputs). These lines provide the address to MT89L85 internal registers.  
20-22  
22  
23  
DS Data Strobe (Input). This is the input for the active high data strobe on the microprocessor  
interface. This input operates with CS to enable the internal read and write generation.  
2
Zarlink Semiconductor Inc.  
1234567...25

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型号 品牌 获取价格 描述 数据表
MT89L85ANR1 ZARLINK

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