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MK74CG117BFLF

更新时间： 2024-01-18 05:53:44

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
8页	167K
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Clock Generator, 100MHz, CMOS, PDSO48, 0.300 INCH, SSOP-48

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MK74CG117BFLF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SSOP
包装说明：	0.300 INCH, SSOP-48	针数：	48
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.19
Is Samacsys：	N	JESD-30 代码：	R-PDSO-G48
JESD-609代码：	e3	长度：	15.875 mm
端子数量：	48	最高工作温度：	70 °C
最低工作温度：		最大输出时钟频率：	100 MHz
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	主时钟/晶体标称频率：	55 MHz
认证状态：	Not Qualified	座面最大高度：	2.8 mm
最大供电电压：	3.63 V	最小供电电压：	3 V
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	7.5 mm
uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER	Base Number Matches：	1

MK74CG117BFLF 数据手册

DATASHEET

16 OUTPUT LOW SKEW CLOCK GENERATOR

MK74CG117B

Description

Features

The MK74CG117B is a monolithic CMOS high speed,

low-skew clock driver that includes an on-chip PLL. Ideal for

communications and other systems that require a large

number of high-speed clocks, the unique combination of

PLL and 16 low-skew outputs can eliminate oscillators and

low skew buffers from systems.

• 48-pin SSOP (300 mil) package

• On-chip PLL generates output clocks up to 100 MHz from

a simple crystal or clock input

• 16 low-skew outputs

• Output skew less than 250 ps on rising edges

• Ability to configure as:

The device has a number of built in multipliers, making it

possible to run from one inexpensive, low frequency crystal,

and produce high frequency clock outputs. Another

selection allows the chip to run as a divider, dividing the

input clock by two (or 4 using the mode select).

– 16 clocks at full frequency

– 12 at full and 4 at half frequency

– 8 at full and 8 at half frequency

The device also has a buffered reference output, allowing

multiple devices to be easily driven from one clock source.

• Tri-state mode for Output Enable function

• 3.3 V 5ꢀ supply voltage

• Industrial temperature version available

NOTE: EOL for non-green parts to occur on 5/13/10

per PDN U-09-01

Block Diagram

VDD

Clock 1

Clock 2

S2:0

Clock

Synthesis

and Mode

Select

M1:0

Circuitry

Clock 16

REF

X1/ICLK

Crystal or

clock input

Crystal

Ocsillator

The crystal requires external capacitors for

accurate tuning of the clock

GND

IDT™ 16 OUTPUT LOW SKEW CLOCK GENERATOR

MK74CG117B

REV E 122209

12 3 4 5 6 7 8

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与MK74CG117BFLF相关器件

型号	品牌	获取价格	描述	数据表
MK74CG117BFLFT	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, 0.300 INCH, SSOP-48
MK74CG117BFLFTR	IDT	获取价格	Clock Generator, CMOS, PDSO48
MK74CG117BFT	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, 0.300 INCH, SSOP-48
MK74CG117FILFT	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, SSOP-48
MK74CG117FLF	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, SSOP-48
MK74CG117FLFT	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, SSOP-48
MK74CG117FT	IDT	获取价格	Clock Generator, 100MHz, CMOS, PDSO48, SSOP-48
MK74ZD133	ICSI	获取价格	PLL and 32-Output Clock Driver
MK74ZD133F	ICSI	获取价格	PLL and 32-Output Clock Driver
MK74ZD133FLF	IDT	获取价格	PLL Based Clock Driver, ZD Series, 32 True Output(s), 0 Inverted Output(s), CMOS, PDSO56,

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