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MC74ACT109N PDF预览

MC74ACT109N

更新时间： 2024-11-30 05:22:19
品牌 Logo 应用领域
安森美 - ONSEMI 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
9页 233K
描述
Dual JK Positive Edge−Triggered Flip−Flop

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MC74ACT109N 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP16,.3
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.7
系列：ACTJESD-30 代码：R-PDIP-T16
JESD-609代码：e0长度：19.175 mm
负载电容（CL）：50 pF逻辑集成电路类型：J-KBAR FLIP-FLOP
最大频率@ Nom-Sup：125000000 Hz最大I（ol）：0.024 A
位数：2功能数量：2
端子数量：16最高工作温度：85 °C
最低工作温度：-40 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP16,.3封装形状：RECTANGULAR
封装形式：IN-LINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：5 V传播延迟（tpd）：13 ns
认证状态：Not Qualified座面最大高度：4.44 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：125 MHzBase Number Matches：1

MC74ACT109N 数据手册

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MC74AC109, MC74ACT109  
Dual JK Positive  
Edge−Triggered Flip−Flop  
The MC74AC109/74ACT109 consists of two high−speed  
completely independent transition clocked JK flip−flops. The clocking  
operation is independent of rise and fall times of the clock waveform.  
The JK design allows operation as a D flip−flop (refer to  
MC74AC74/74ACT74 data sheet) by connecting the J and K inputs  
together.  
http://onsemi.com  
Asynchronous Inputs:  
DIP−16  
N SUFFIX  
CASE 648  
LOW input to S (Set) sets Q to HIGH level  
LOW input to C (Clear) sets Q to LOW level  
D
16  
D
Clear and Set are independent of clock  
1
Simultaneous LOW on C and S makes both Q and Q HIGH  
D
D
SO−16  
D SUFFIX  
CASE 751B  
• Outputs Source/Sink 24 mA  
• ′ACT109 Has TTL Compatible Inputs  
16  
1
V
C
J
2
K
CP  
S
Q
Q
2
CC  
D2  
2
2
D2  
2
16  
15  
14  
13  
12  
11  
10  
9
TSSOP−16  
DT SUFFIX  
CASE 948F  
C
J
K
CP  
S
D
Q
16  
D
Q
1
C
D1  
J
K
1
CP  
S
D1  
Q
Q
1
1
1
1
EIAJ−16  
M SUFFIX  
CASE 966  
1
2
4
5
6
7
8
3
16  
C
J
1
K
CP  
S
Q
Q
GND  
D1  
1
1
D1  
1
1
1
Figure 1. Pinout; 16−Lead Packages Conductors  
ORDERING INFORMATION  
(Top View)  
Device  
Package  
Shipping  
PIN ASSIGNMENT  
MC74AC109N  
MC74ACT109N  
MC74AC109D  
MC74ACT109D  
MC74AC109DR2  
25 Units/Rail  
25 Units/Rail  
48 Units/Rail  
48 Units/Rail  
PDIP−16  
PDIP−16  
SOIC−16  
SOIC−16  
PIN  
J , J , K , K  
2
FUNCTION  
Data Inputs  
1
2
1
CP , CP  
Clock Pulse Inputs  
Direct Clear Inputs  
Direct Set Inputs  
Outputs  
1
2
C , C  
D1 D2  
SOIC−16 2500 Tape & Reel  
S
, S  
D1 D2  
MC74ACT109DR2  
MC74AC109DT  
2500 Tape & Reel  
96 Units/Rail  
SOIC−16  
Q , Q , Q ,  
1
2
2
1
TSSOP−16  
Q
MC74ACT109DT  
MC74AC109DTR2  
MC74ACT109DTR2  
MC74AC109M  
96 Units/Rail  
2500 Tape & Reel  
2500 Tape & Reel  
50 Units/Rail  
TSSOP−16  
TSSOP−16  
TSSOP−16  
EIAJ−16  
50 Units/Rail  
MC74ACT109M  
MC74AC109MEL  
MC74ACT109MEL  
EIAJ−16  
2000 Tape & Reel  
2000 Tape & Reel  
EIAJ−16  
EIAJ−16  
DEVICE MARKING INFORMATION  
See general marking information in the device marking  
section on page 6 of this data sheet.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
June, 2006 − Rev. 6  
MC74AC109/D  
1234567...9

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与MC74ACT109N相关器件

型号 品牌 获取价格 描述 数据表
MC74ACT109NC MOTOROLA

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 		ACT SERIES, DUAL POSITIVE EDGE TRIGGERED J-KBAR FLIP-FLOP, COMPLEMENTARY OUTPUT, PDIP16, P
MC74ACT10D MOTOROLA

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