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MC100LVEL56DW PDF预览

MC100LVEL56DW

更新时间： 2024-01-18 07:17:15
品牌 Logo 应用领域
安森美 - ONSEMI 解复用器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
7页 120K
描述
3.3V ECL Dual Differential 2:1 Multiplexer

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MC100LVEL56DW 技术参数

是否无铅： 含铅生命周期：Active
零件包装代码：SOIC包装说明：LEAD FREE, SOP-20
针数：20Reach Compliance Code：unknown
风险等级：5.7Is Samacsys：N
其他特性：NECL MODE: VCC = 0V WITH VEE = -3V TO -3.8V系列：100LVEL
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：12.8 mm逻辑集成电路类型：MULTIPLEXER
湿度敏感等级：NOT SPECIFIED功能数量：2
输入次数：2输出次数：1
端子数量：20最高工作温度：85 °C
最低工作温度：-40 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260传播延迟（tpd）：0.62 ns
认证状态：COMMERCIAL座面最大高度：2.65 mm
最大供电电压 (Vsup)：3.8 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：ECL温度等级：INDUSTRIAL
端子面层：MATTE TIN端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：7.5 mm
Base Number Matches：1

MC100LVEL56DW 数据手册

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MC100LVEL56  
3.3VꢀECL Dual Differential  
2:1 Multiplexer  
Description  
The MC100LVEL56 is a dual, fully differential 2:1 multiplexer. The  
differential data path makes the device ideal for multiplexing low skew  
clock or other skew sensitive signals.  
http://onsemi.com  
The device features both individual and common select inputs to  
address both data path and random logic applications.  
The differential inputs have special circuitry which ensures device  
stability under open input conditions. When both differential inputs are  
left open the D input will pull down to V , The D input will bias  
EE  
around V /2 forcing the Q output LOW.  
CC  
SO−20 WB  
DW SUFFIX  
CASE 751D  
The V pin, an internally generated voltage supply, is available to  
BB  
this device only. For single-ended input conditions, the unused  
differential input is connected to V as a switching reference voltage.  
BB  
V
V
may also rebias AC coupled inputs. When used, decouple V and  
via a 0.01 mF capacitor and limit current sourcing or sinking to  
BB  
BB  
CC  
MARKING DIAGRAM*  
0.5 mA. When not used, V should be left open.  
BB  
Features  
20  
• 580 ps Typical Propagation Delays  
• Separate and Common Select  
• The 100 Series Contains Temperature Compensation  
• PECL Mode Operating Range:  
100LVEL56  
AWLYYWWG  
V
= 3.0 V to 3.8 V with V = 0 V  
1
CC  
EE  
• NECL Mode Operating Range:  
= 0 V with V = −3.0 V to −3.8 V  
• Internal Input Pulldown Resistors on D(s), SEL(s), and COM_SEL  
• Q Output will Default LOW with Inputs Open or at V  
• Pb−Free Packages are Available*  
A
= Assembly Location  
= Wafer Lot  
= Year  
= Work Week  
= Pb−Free Package  
V
CC  
EE  
WL  
YY  
WW  
G
EE  
*For additional marking information, refer to  
Application Note AND8002/D.  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
dimensions section on page 6 of this data sheet.  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
©
Semiconductor Components Industries, LLC, 2006  
1
Publication Order Number:  
November, 2006 − Rev. 11  
MC100LVEL56/D  
1234567

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