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MC100EP14DT

更新时间： 2024-01-28 21:00:20
品牌 Logo 应用领域
安森美 - ONSEMI 时钟驱动器
页数 文件大小 规格书
8页 70K
描述
3.3V / 5V 1:5 Differential ECL/PECL/HSTL Clock Driver

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MC100EP14DT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP, TSSOP20,.25针数：20
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：5.19其他特性：NECL MODE: VCC = 0V WITH VEE = -3V TO -5.5V
系列：100E输入调节：DIFFERENTIAL MUX
JESD-30 代码：R-PDSO-G20JESD-609代码：e4
长度：6.5 mm逻辑集成电路类型：LOW SKEW CLOCK DRIVER
湿度敏感等级：1功能数量：1
反相输出次数：端子数量：20
实输出次数：5最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260电源：-4.5 V
Prop。Delay @ Nom-Sup：0.6 ns传播延迟（tpd）：0.45 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.045 ns
座面最大高度：1.2 mm子类别：Clock Drivers
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：ECL温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：40宽度：4.4 mm
Base Number Matches：1

MC100EP14DT 数据手册

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MC100EP14  
3.3V / 5Vꢀ1:5 Differential  
ECL/PECL/HSTL Clock Driver  
The MC100EP14 is a low skew 1−to−5 differential driver, designed with  
clock distribution in mind, accepting two clock sources into an input  
multiplexer. The ECL/PECL input signals can be either differential or  
http://onsemi.com  
single−ended (if the V output is used). HSTL inputs can be used when  
BB  
the LVEP14 is operating under PECL conditions.  
The EP14 specifically guarantees low output−to−output skew. Optimal  
design, layout, and processing minimize skew within a device and from  
device to device.  
To ensure that the tight skew specification is realized, both sides of  
any differential output need to be terminated even if only one output is  
being used. If an output pair is unused, both outputs may be left open  
(unterminated) without affecting skew.  
The common enable (EN) is synchronous, outputs are enabled/  
disabled in the LOW state. This avoids a runt clock pulse when the  
device is enabled/disabled as can happen with an asynchronous  
control. The internal flip flop is clocked on the falling edge of the input  
clock, therefore all associated specification limits are referenced to the  
negative edge of the clock input.  
TSSOP−20  
DT SUFFIX  
CASE 948E  
MARKING DIAGRAM*  
20  
The MC100EP14, as with most other ECL devices, can be operated  
from a positive V supply in PECL mode. This allows the EP14 to be  
CC  
100  
used for high performance clock distribution in 5.0 V systems.  
Designers can take advantage of the EP14’s performance to distribute  
low skew clocks across the backplane or the board.  
EP14  
ALYW  
1
• 400 ps Typical Propagation Delay  
• 100 ps Device−to−Device Skew  
• 25 ps Within Device Skew  
A
L
Y
= Assembly Location  
= Wafer Lot  
= Year  
W
= Work Week  
• Maximum Frequency > 2 GHz Typical  
• The 100 Series Contains Temperature Compensation  
• PECL and HSTL Mode:  
*For additional marking information, refer to  
Application Note AND8002/D.  
V
CC  
= 3.0 V to 5.5 V with V = 0 V  
EE  
• NECL Mode:  
= 0 V with V = −3.0 V to −5.5 V  
ORDERING INFORMATION  
See detailed ordering and shipping information in the package  
V
CC  
EE  
dimensions section on page 6 of this data sheet.  
• Open Input Default State  
• These are Pb−Free Devices  
*For additional information on our Pb−Free strategy and soldering details, please  
download the ON Semiconductor Soldering and Mounting Techniques  
Reference Manual, SOLDERRM/D.  
Semiconductor Components Industries, LLC, 2004  
1
Publication Order Number:  
June, 2004 − Rev. 3  
MC100EP14/D  
12345678

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MC100EP14DT 替代型号

型号 品牌 替代类型 描述 数据表
MC100EP14DTR2G ONSEMI

完全替代

 3.3V / 5V 1:5 Differential ECL/PECL/HSTL Clock Driver
MC100LVEP14DTG ONSEMI

类似代替

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