LMK04011BISQ

更新时间： 2024-11-14 11:37:19

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美国国家半导体 - NSC		时钟驱动器逻辑集成电路信息通信管理
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Low-Noise Clock Jitter Cleaner with Cascaded PLLs

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LMK04011BISQ 技术参数

是否Rohs认证：	不符合	生命周期：	Transferred
包装说明：	7 X 7 MM, 0.80 MM HIGHT, LLP-48	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.35
Is Samacsys：	N	系列：	4000/14000/40000
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e0	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.0005 A
湿度敏感等级：	2	功能数量：	1
反相输出次数：		端子数量：	48
实输出次数：	5	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC48,.27SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	电源：	3.3 V
认证状态：	Not Qualified	Same Edge Skew-Max（tskwd）：	0.1 ns
座面最大高度：	0.8 mm	子类别：	Clock Drivers
最大供电电压 (Vsup)：	3.45 V	最小供电电压 (Vsup)：	3.15 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	BICMOS	温度等级：	INDUSTRIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	7 mm	Base Number Matches：	1

LMK04011BISQ 数据手册

September 10, 2010

LMK04000 Family

Low-Noise Clock Jitter Cleaner with Cascaded PLLs

1.0 General Description

2.0 Features

The LMK04000 family of precision clock conditioners pro-

vides low-noise jitter cleaning, clock multiplication and distri-

bution without the need for high-performance voltage con-

trolled crystal oscillators (VCXO) module. Using a cascaded

PLLatinum™ architecture combined with an external crystal

and varactor diode, the LMK04000 family provides sub-200

femtosecond (fs) root mean square (RMS) jitter performance.

Cascaded PLLatinum PLL Architecture

■

PLL1

—

Phase detector rate of up to 40 MHz

■

Integrated Low-Noise Crystal Oscillator Circuit

Dual redundant input reference clock with LOS

PLL2

—

Normalized [1 Hz] PLL noise floor of -224 dBc/Hz

■

The cascaded architecture consists of two high-performance

phase-locked loops (PLL), a low-noise crystal oscillator cir-

cuit, and a high-performance voltage controlled oscillator

(VCO). The first PLL (PLL1) provides a low-noise jitter cleaner

function while the second PLL (PLL2) performs the clock gen-

eration. PLL1 can be configured to either work with an exter-

nal VCXO module or use the integrated crystal oscillator with

an external crystal and a varactor diode. When used with a

very narrow loop bandwidth, PLL1 uses the superior close-in

phase noise (offsets below 50 kHz) of the VCXO module or

the crystal to clean the input clock. The output of PLL1 is used

as the clean input reference to PLL2 where it locks the inte-

grated VCO. The loop bandwidth of PLL2 can be optimized

to clean the far-out phase noise (offsets above 50 kHz) where

the integrated VCO outperforms the VCXO module or crystal

used in PLL1.

Phase detector rate up to 100 MHz

Input frequency-doubler

Integrated Low-Noise VCO

Ultra-Low RMS Jitter Performance

■

150 fs RMS jitter (12 kHz – 20 MHz)

200 fs RMS jitter (100 Hz – 20 MHz)

—

LVPECL/2VPECL, LVDS, and LVCMOS outputs

■

Support clock rates up to 1080 MHz

Default Clock Output (CLKout2) at power up

Five dedicated channel divider and delay blocks

Pin compatible family of clocking devices

Industrial Temperature Range: -40 to 85 °C

3.15 V to 3.45 V operation

The LMK04000 family features dual redundant inputs, five

differential outputs, and an optional default-clock upon power

up. The input block is equipped with loss of signal detection

and automatic or manual selection of the reference clock.

Each clock output consists of a programmable divider, a

phase synchronization circuit, a programmable delay, and an

LVDS, LVPECL, or LVCMOS output buffer. The default start-

up clock is available on CLKout2 and it can be used to provide

an initial clock for the field-programmable gate array (FPGA)

or microcontroller that programs the jitter cleaner during the

system power up sequence.

Package: 48 pin LLP (7.0 x 7.0 x 0.8 mm)

3.0 Target Applications

Data Converter Clocking

■

Wireless Infrastructure

Networking, SONET/SDH, DSLAM

Medical

Military / Aerospace

Test and Measurement

Video

30027140

PLLatinum™ is a trademark of National Semiconductor Corporation.

TRI-STATE^®is a registered trademark of National Semiconductor Corporation.

300271

www.national.com

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型号	品牌	获取价格	描述	数据表
LMK04011BISQ/NOPB	TI	获取价格	具有 1430 至 1570MHz VCO 的低噪声抖动消除器：5 路输出用于 2VPEC
LMK04011BISQE	NSC	获取价格	Low-Noise Clock Jitter Cleaner with Cascaded PLLs
LMK04011BISQE/NOPB	TI	获取价格	具有 1430 至 1570MHz VCO 的低噪声抖动消除器：5 路输出用于 2VPEC
LMK04011BISQX	NSC	获取价格	Low-Noise Clock Jitter Cleaner with Cascaded PLLs
LMK04011BISQX/NOPB	TI	获取价格	具有 1430 至 1570MHz VCO 的低噪声抖动消除器：5 路输出用于 2VPEC
LMK04031	TI	获取价格	具有 1430MHz 至 1570MHz VCO 的低噪声抖动消除器：2 路输出用于 2V
LMK04031BISQ	NSC	获取价格	Low-Noise Clock Jitter Cleaner with Cascaded PLLs
LMK04031BISQ/NOPB	TI	获取价格	具有 1430MHz 至 1570MHz VCO 的低噪声抖动消除器：2 路输出用于 2V
LMK04031BISQE	NSC	获取价格	Low-Noise Clock Jitter Cleaner with Cascaded PLLs
LMK04031BISQE/NOPB	TI	获取价格	具有 1430MHz 至 1570MHz VCO 的低噪声抖动消除器：2 路输出用于 2V

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