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LMK00308SQE

更新时间： 2024-11-20 11:46:03

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德州仪器 - TI		转换器电平转换器时钟
页数	文件大小	规格书
25页	1459K
描述
3-GHz 8-Output Differential Clock Buffer/Level Translator

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LMK00308SQE 技术参数

生命周期：	Obsolete	零件包装代码：	QFN
包装说明：	6 X 6 MM, 0.80 MM HEIGHT, LLP-40	针数：	40
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.72	系列：	00308
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-XQCC-N40
长度：	6 mm	逻辑集成电路类型：	LOW SKEW CLOCK DRIVER
功能数量：	1	反相输出次数：
端子数量：	40	实输出次数：	16
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
Same Edge Skew-Max（tskwd）：	0.05 ns	座面最大高度：	0.8 mm
最大供电电压 (Vsup)：	3.45 V	最小供电电压 (Vsup)：	3.15 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子形式：	NO LEAD
端子节距：	0.5 mm	端子位置：	QUAD
宽度：	6 mm	Base Number Matches：	1

LMK00308SQE 数据手册

March 14, 2012

LMK00308

3-GHz 8-Output Differential Clock Buffer/Level Translator

Servers, Workstations, and Computing

■

1.0 General Description

The LMK00308 is a 3-GHz, 8-output differential fanout buffer

3.0 Features

intended for high-frequency, low-jitter clock/data distribution

3:1 Input Multiplexer

■

and level translation. The input clock can be selected from

two universal inputs or one crystal input. The selected input

clock is distributed to two banks of 4 differential outputs and

one LVCMOS output. Both differential output banks can be

independently configured as LVPECL, LVDS, or HCSL

drivers, or disabled. The LVCMOS output has a synchronous

enable input for runt-pulse-free operation when enabled or

disabled. The LMK00308 operates from a 3.3 V core supply

and 3 independent 3.3 V/2.5 V output supplies..

Two universal inputs operate up to 3.1 GHz and accept

LVPECL, LVDS, CML, SSTL, HSTL, HCSL (AC-

coupled), or single-ended clocks

—

One crystal input accepts a 10 to 40 MHz crystal or

single-ended clock

—

Two Banks with 4 Differential Outputs each

■

LVPECL, LVDS, HCSL, or Hi-Z (selectable per bank)

—

LVPECL Additive Jitter with LMK03806 clock source

The LMK00308 provides high performance, versatility, and

power efficiency, making it ideal for replacing fixed-output

buffer devices while increasing timing margin in the system.

20 fs RMS at 156.25 MHz (10 kHz – 1 MHz)

51 fs RMS at 156.25 MHz (12 kHz – 20 MHz)

■

High PSRR: -65 / -76 dBc (LVPECL/LVDS) at 156.25 MHz

LVCMOS output with synchronous enable input

Pin-controlled configuration

■

2.0 Target Applications

Clock Distribution and Level Translation for high-speed

■

V_CCCore Supply: 3.3 V ± 5%

ADCs, DACs, Serial Interfaces (Multi-Gigabit Ethernet,

XAUI, Fibre Channel, PCIe, SATA/SAS, SONET/SDH,

CPRI), and high-frequency backplanes

3 Independent V_CCOOutput Supplies: 3.3 V/2.5 V ± 5%

Industrial temperature range: -40°C to +85°C

Package: 40-pin LLP (6.0 x 6.0 x 0.8 mm)

Remote Radio Units (RRU) and Baseband Units (BBU)

■

Switches and Routers

4.0 Functional Block Diagram

30177601

301776 SNAS576A

www.ti.com

12 3 4 5 6 7...25

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