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LF3312QC10

更新时间： 2024-11-29 15:44:55

品牌	Logo	应用领域
逻辑 - LOGIC		内存集成电路
页数	文件大小	规格书
34页	979K
描述
Memory Circuit, 518400X24, CMOS, PBGA169, BGA-169

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LF3312QC10 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	BGA	包装说明：	BGA, QFP100,.63X.87
针数：	169	Reach Compliance Code：	compliant
HTS代码：	8542.32.00.71	风险等级：	5.76
最长访问时间：	6 ns	JESD-30 代码：	R-PBGA-B169
JESD-609代码：	e0	内存密度：	12441600 bit
内存集成电路类型：	MEMORY CIRCUIT	内存宽度：	24
湿度敏感等级：	3	功能数量：	1
端子数量：	169	字数：	518400 words
字数代码：	518400	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	518400X24	封装主体材料：	PLASTIC/EPOXY
封装代码：	BGA	封装等效代码：	QFP100,.63X.87
封装形状：	RECTANGULAR	封装形式：	GRID ARRAY
峰值回流温度（摄氏度）：	225	电源：	3.3 V
认证状态：	Not Qualified	子类别：	Other Memory ICs
最大压摆率：	0.1 mA	最大供电电压 (Vsup)：	1.9 V
最小供电电压 (Vsup)：	1.7 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	BALL	端子节距：	0.635 mm
端子位置：	BOTTOM	处于峰值回流温度下的最长时间：	NOT SPECIFIED
Base Number Matches：	1

LF3312QC10 数据手册

LF3312

12-Mbit Frame Buffer / FIFO

DEVICES INCORPORATED

Advance Information

Features

12,441,600-bit Frame Memory

Features in the Four Modes With

Asynchronous FIFOs:

May be Organized Into the Following

Conﬁgurations:

• Near-Full/Empty Flags With Programmable

Thresholds

• 1,555,200 x 8-bit (single channel)

• 1,244,160 x 10-bit (single channel)

• 1,036,800 x 12-bit (single channel)

• 777,600 x 16-bit (single channel)

• 622,080 x 20-bit (single channel)

• 518,400 x 24-bit (single channel)

Features in the Six Purely Sequential (FIFO,

shift register) Modes:

• Up to 100 MHz Continuous Data

Throughput Rate

Features in the Two Random Access (non-

FIFO) Modes:

• 777,600 x 8-bit

(each of two parallel channels)

• 622,080 x 10-bit (each of two parallel channels)

• 518,400 x 12-bit (each of two parallel channels)

Eight Operating Modes:

• Up to 83 MHz Data Rate

LF3312s may be Connected in Parallel for

HDTV, Multiframe SDTV, etc.

Built-in ITUR-656 TRS detection and

Synchronization

• One-Channel Synchronous Shift Register (Single

Clock Source)

• One-Channel Framestore With Sequential Write

and Random Access Read

User-Set/Resettable Read and Write Pointers

Choice of Control Interfaces:

• Two-wire Serial Microprocessor Interface

• Parallel Microprocessor Interface

Input Enable Control (Write Mask)

Output Enable Control (Data Skipping)

172 ball BGA

• One-Channel Framestore With Random Access

Write and Sequential Read

• One-Channel FIFO With Asynchronous I/O

• Two-Channel Synchronous Shift Register (Single

Clock Source)

• FIFO + shift register; Channel B Synchronized to

Channel A

1.8V Internal Core Power Supply

3.3V I/O Supply

• Shift register + FIFO; Channel A Synchronized to

Channel B

5V-Tolerant I/O

• Two-Channel FIFO; Both Channels Sychronized

to External Signal (a)

(a) power-up default mode

Applications

Field-Based or Frame-Based Comb Filtering

Image or Data Sequence Capture

Resynchronization of Data Streams

Video Special Effects (Rotation, Zoom, Picture-in-Picture)

Test Pattern Generation

High Speed Data Buffering

Motion Detection or Frame-to-Frame Correlation

Closed Circuit or Security Camera Systems

Video Imaging Product

LOGIC Devices Incorporated

Jan 23, 2004 LDS.3312 C

12 3 4 5 6 7...34

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型号	品牌	获取价格	描述	数据表
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LF3320QC15G	LOGIC	获取价格	Digital Filter, 12-Bit, CMOS, PQFP144, GREEN, PLASTIC, QFP-144
LF3320QC18	ETC	获取价格	Digital Filter
LF3320QC25	ETC	获取价格	Digital Filter
LF3320QC9	LOGIC	获取价格	Digital Filter, 12-Bit, CMOS, PQFP144, PLASTIC, QFP-144
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