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LA4064V-75TN44E

更新时间： 2024-10-28 03:50:15

品牌	Logo	应用领域
莱迪思 - LATTICE		可编程逻辑器件
页数	文件大小	规格书
42页	240K
描述
3.3V/1.8V In-System Programmable SuperFAST High Density PLDs

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LA4064V-75TN44E 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	QFP
包装说明：	TQFP, TQFP44,.47SQ,32	针数：	44
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.71
其他特性：	YES	最大时钟频率：	168 MHz
系统内可编程：	YES	JESD-30 代码：	S-PQFP-G44
JESD-609代码：	e3	JTAG BST：	YES
长度：	10 mm	湿度敏感等级：	3
专用输入次数：		I/O 线路数量：	30
宏单元数：	64	端子数量：	44
最高工作温度：	125 °C	最低工作温度：	-40 °C
组织：	0 DEDICATED INPUTS, 30 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	TQFP
封装等效代码：	TQFP44,.47SQ,32	封装形状：	SQUARE
封装形式：	FLATPACK, THIN PROFILE	峰值回流温度（摄氏度）：	260
电源：	3.3 V	可编程逻辑类型：	EE PLD
传播延迟：	8 ns	认证状态：	Not Qualified
筛选级别：	AEC-Q100	座面最大高度：	1.2 mm
子类别：	Programmable Logic Devices	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	40
宽度：	10 mm	Base Number Matches：	1

LA4064V-75TN44E 数据手册

LA-ispMACH 4000V/Z

Automotive Family

3.3V/1.8V In-System Programmable

SuperFAST High Density PLDs

July 2008

Data Sheet DS1017

• 5V tolerant I/O for LVCMOS 3.3, LVTTL, and PCI

interfaces

• Hot-socketing

Features

■ High Performance

• f

= 168MHz maximum operating frequency

MAX

• Open-drain capability

• t = 7.5ns propagation delay

• Input pull-up, pull-down or bus-keeper

• Programmable output slew rate

• 3.3V PCI compatible

• IEEE 1149.1 boundary scan testable

• 3.3V/2.5V/1.8V In-System Programmable

(ISP™) using IEEE 1532 compliant interface

• I/O pins with fast setup path

• Lead-free (RoHS) package

• Up to four global clock pins with programmable

clock polarity control

• Up to 80 PTs per output

■ Ease of Design

• Enhanced macrocells with individual clock,

reset, preset and clock enable controls

• Up to four global OE controls

• Individual local OE control per I/O pin

• Excellent First-Time-Fit^TMand reﬁt

• Fast path, SpeedLocking^TMPath, and wide-PT

path

Introduction

The high performance LA-ispMACH 4000V/Z automo-

tive family from Lattice offers a SuperFAST CPLD solu-

tion that is tested and qualiﬁed to the AEC-Q100

• Wide input gating (36 input logic blocks) for fast

counters, state machines and address decoders standard. The family is a blend of Lattice’s two most

popular architectures: the ispLSI^®2000 and ispMACH

■ Zero Power (LA-ispMACH 4000Z)

4A. Retaining the best of both families, the LA-ispMACH

• Typical static current 10µA (4032Z)

4000V/Z architecture focuses on signiﬁcant innovations

• 1.8V core low dynamic power

to combine the highest performance with low power in a

• LA-ispMACH 4000Z operational down to 1.6V

ﬂexible CPLD family.

■ AEC-Q100 Tested and Qualiﬁed

The LA-ispMACH 4000V/Z automotive family combines

high speed and low power with the ﬂexibility needed for

ease of design. With its robust Global Routing Pool and

Output Routing Pool, this family delivers excellent First-

Time-Fit, timing predictability, routing, pin-out retention

and density migration.

• Automotive: -40 to 125°C ambient (T )

■ Easy System Integration

• Superior solution for power sensitive consumer

applications

• Operation with 3.3V, 2.5V or 1.8V LVCMOS I/O

• Operation with 3.3V (4000V) or 1.8V (4000Z)

supplies

Table 1. LA-ispMACH 4000V Automotive Family Selection Guide

LA-ispMACH 4032V

LA-ispMACH 4064V

LA-ispMACH 4128V

Macrocells

30+2/32+4

7.5

128

I/O + Dedicated Inputs

30+2/32+4/64+10

64+10/92+4/96+4

(ns)

7.5

4.5

7.5

4.5

t (ns)

4.5

(ns)

4.5

(MHz)

168

3.3V

168

3.3V

MAX

Supply Voltage (V)

Pins/Package

3.3V

44-pin Lead-Free TQFP

48-pin Lead-Free TQFP

44-pin Lead-Free TQFP

48-pin Lead-Free TQFP

100-pin Lead-Free TQFP

128-pin Lead-Free TQFP

144-pin Lead-Free TQFP

or product names are trademarks or registered trademarks of their respective holders. The speciﬁcations and information herein are subject to change without notice.

www.latticesemi.com

DS1017_02.3

12 3 4 5 6 7...42

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M4A5-32/32-12VI	LATTICE	类似代替	High Performance E 2 CMOS In-System Programmable Logic

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