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IDT74LVC16601APAG PDF预览

IDT74LVC16601APAG

更新时间： 2024-11-11 20:57:51
品牌 Logo 应用领域
艾迪悌 - IDT 光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
6页 81K
描述
Registered Bus Transceiver, LVC/LCX/Z Series, 1-Func, 18-Bit, True Output, CMOS, PDSO56, GREEN, TSSOP-56

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IDT74LVC16601APAG 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：TSSOP包装说明：GREEN, TSSOP-56
针数：56Reach Compliance Code：compliant
风险等级：5.83其他特性：WITH INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION
系列：LVC/LCX/ZJESD-30 代码：R-PDSO-G56
JESD-609代码：e3长度：14 mm
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER湿度敏感等级：1
位数：18功能数量：1
端口数量：2端子数量：56
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260传播延迟（tpd）：6.3 ns
认证状态：Not Qualified座面最大高度：1.1 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn) - annealed端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：6.1 mm
Base Number Matches：1

IDT74LVC16601APAG 数据手册

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IDT74LVC16601A  
3.3V CMOS  
18-BIT UNIVERSAL BUS  
TRANSCEIVER WITH 3 STATE OUTPUTS,  
5 VOLT TOLERANT I/O  
DESCRIPTION:  
FEATURES:  
The LVC16601A18-bit universal bus transceiver is built using advanced  
• Typical tSK(o) (Output Skew) < 250ps  
• ESD > 2000V per MIL-STD-883, Method 3015; > 200V using  
machine model (C = 200pF, R = 0)  
dual metal CMOS technology. This 18-bit universal bus transceiver com-  
bines D-type latches and D-type flip-flops to allow data flow in transparent,  
• VCC = 3.3V ± 0.3V, Normal Range  
• VCC = 2.7V to 3.6V, Extended Range  
• CMOS power levels (0.4μ W typ. static)  
• All inputs, outputs, and I/O are 5V tolerant  
• Supports hot insertion  
latched and clocked modes.  
Data flow in each direction is controlled by output-enable (OEAB and  
OEBA), latch-enable (LEABandLEBA), andclock(CLKABandCLKBA)  
inputs. The clock can be controlled by the clock-enable (CLKENAB and  
CLKENBA)inputs.  
• Available in SSOP and TSSOP packages  
ForA-to-Bdataflow,thedeviceoperates inthetransparentmodewhen  
LEABis high. WhenLEABis low,the Adata is latchedifCLKABis heldat  
ahighorlowlogiclevel. IfLEABis low,theA-bus datais storedinthelatch/  
flip-flopontheLOW-to-HIGHtransitionofCLKAB.OutputenableOEABis  
activelow. WhenOEABislow,theoutputsareactive. WhenOEABishigh,  
the outputs are inthe high-impedance state.Data flowforBtoAis similar  
to that of A to B but uses OEBA, LEBA, CLKBA and CLKENBA.  
Allpinscanbedrivenfromeither3.3Vor5Vdevices. Thisfeatureallows  
the use of this device as a translator in a mixed 3.3V/5V supply system.  
The LVC16601Ahas beendesignedwitha ±24mAoutputdriver. This  
driver is capable of driving a moderate to heavy load while maintaining  
speedperformance.  
DRIVE FEATURES:  
• High Output Drivers: ±24mA  
• Reduced system switching noise  
APPLICATIONS:  
• 5V and 3.3V mixed voltage systems  
• Data communication and telecommunication systems  
FUNCTIONALBLOCKDIAGRAM  
1
OEAB  
56  
CLKENAB  
55  
CLKAB  
2
LEAB  
28  
LEBA  
30  
CLKBA  
29  
CLKENBA  
27  
OEBA  
CE  
1D  
C1  
54  
3
A1  
B1  
CLK  
CE  
1D  
C1  
CLK  
TO 17 OTHER CHANNELS  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
INDUSTRIAL TEMPERATURE RANGE  
JUNE 2006  
1
©
2006 Integrated Device Technology, Inc.  
DSC-4599/5  
123456

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