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IDT74ALVCHR16500PA8

更新时间： 2024-11-09 14:51:27
品牌 Logo 应用领域
艾迪悌 - IDT 光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
7页 71K
描述
Registered Bus Transceiver, ALVC/VCX/A Series, 1-Func, 18-Bit, True Output, CMOS, PDSO56, TSSOP-56

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IDT74ALVCHR16500PA8 技术参数

生命周期：Obsolete零件包装代码：TSSOP
包装说明：TSSOP,针数：56
Reach Compliance Code：unknown风险等级：5.84
Is Samacsys：N其他特性：WITH INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION
系列：ALVC/VCX/AJESD-30 代码：R-PDSO-G56
JESD-609代码：e0长度：14 mm
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER位数：18
功能数量：1端口数量：2
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE WITH SERIES RESISTOR
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH传播延迟（tpd）：7.3 ns
认证状态：Not Qualified座面最大高度：1.2 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：TIN LEAD端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
宽度：6.1 mmBase Number Matches：1

IDT74ALVCHR16500PA8 数据手册

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3.3V CMOS 18-BIT UNIVERSAL IDT74ALVCHR16500  
BUS TRANSCEIVER WITH  
3-STATE OUTPUTS  
AND BUS-HOLD  
FEATURES:  
DESCRIPTION:  
• 0.5 MICRON CMOS Technology  
• Typical tSK(o) (Output Skew) < 250ps  
This 18-bit universal bus transceiver is built using advanced dual metal  
CMOStechnology.Dataflowineachdirectioniscontrolledbyoutput-enable  
• ESD > 2000V per MIL-STD-883, Method 3015; > 200V using  
machine model (C = 200pF, R = 0)  
• VCC = 3.3V ± 0.3V, Normal Range  
• VCC = 2.7V to 3.6V, Extended Range  
• VCC = 2.5V ± 0.2V  
• CMOS power levels (0.4µ W typ. static)  
• Rail-to-Rail output swing for increased noise margin  
• Available in SSOP, TSSOP, and TVSOP packages  
(OEAB and OEBA), latch enable (LEAB and LEBA) and clock (CLKAB and  
CLKBA)inputs.ForA-to-Bdataflow,thedeviceoperatesintransparentmode  
whenLEABishigh. WhenLEABisLOW,theAdataislatchedifCLKABisheld  
atahighorlowlogiclevel.IfLEABisLOW,theAbusdataisstoredinthelatch/  
flip-floponthehigh-to-lowtransitionofCLKAB.OEABperformstheoutputenable  
functionontheBport.DataflowfromBporttoAportissimiliarbutrequiresusing  
OEBA,LEBAandCLKBA.Flow-throughorganizationofsignalpinssimplifies  
layout.Allinputsaredesignedwithhysteresisforimprovednoisemargin.  
TheALVCHR16500hasseriesresistorsinthedeviceoutputstructurewhich  
willsignificantlyreducereducelinenoisewhenusedwithlightloads.Thisdriver  
hasbeendesignedtodrive±12mAatthedesignatedthresholdlevels.  
The ALVCHR16500 has “bus-hold” which retains the inputs’ last state  
whenevertheinputbusgoestoahighimpedance.Thispreventsfloatinginputs  
andeliminatestheneedforpull-up/downresistors.  
DRIVE FEATURES:  
• Balanced Output Drivers: ±12mA  
• Low Switching Noise  
APPLICATIONS:  
• 3.3V high speed systems  
• 3.3V and lower voltage computing systems  
FUNCTIONALBLOCKDIAGRAM  
1
OEAB  
55  
CLKAB  
2
LEAB  
28  
LEBA  
30  
CLKBA  
27  
OEBA  
1D  
A1  
54  
B1  
C1  
CLK  
1D  
C1  
CLK  
TO 17 OTHER CHANNELS  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
INDUSTRIAL TEMPERATURE RANGE  
JULY 1999  
1
© 1999 Integrated Device Technology, Inc.  
DSC-4533/1  
1234567

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