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ICSSSTUB32864AHMLF

更新时间： 2024-11-14 07:37:35

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艾迪悌 - IDT		/
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Interface Circuit

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ICSSSTUB32864AHMLF 技术参数

生命周期：	Obsolete	包装说明：	,
Reach Compliance Code：	unknown	风险等级：	5.84

ICSSSTUB32864AHMLF 数据手册

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ICSSSTUB32864A

Advance Information

Integrated

Circuit

Systems,Inc.

25-Bit Configurable Registered Buffer for DDR2

Pin Configuration

Recommended Application:

•

DDR2 Memory Modules

•

Provides complete DDR DIMM solution with

ICS97U877

Ideal for DDR2 400, 533, 667 and 800

•

Product Features:

•

25-bit 1:1 or 14-bit 1:2 configurable registered buffer

Supports SSTL_18 JEDEC specification on data

inputs and outputs

Supports LVCMOS switching levels on C0, C1 and

RESET# inputs

Low voltage operation

V_DD= 1.7V to 1.9V

•

Available in 96 BGA package

Drop-in replacement for ICSSSTUB32866

Green packages available

96 Ball BGA

(Top View)

Truth Table

Ball Assignments

Inputs

Outputs

QCS#

DCKE

V_REF

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

V_REF

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

GND

V_DD

QCKE

Dn,

DODT,

DCKE

D15

D16

Q15

Q16

QODT,

QCKE

RST#

DCS#

CSR#

CK#

DODT

QODT

D17

D18

RST#

DCS#

CSR#

D19

D20

D21

D22

D23

D24

D25

Q17

Q18

L or H

QCS#

ZOH

CK#

ZOL

Q19

Q20

Q21

Q22

Q23

Q24

Q25

L or H

X or

L or H

X or

D10

D11

D12

D13

D14

Q10

Q11

Q12

Q13

Q14

X or

Floating Floating Floating Floating Floating

1:1 Register (C0 = 0, C1 = 0)

1166—10/05/05

12 3 4 5 6 7...12

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