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ICS8432DY-101LF

更新时间： 2024-11-05 02:55:31

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艾迪悌 - IDT		驱动逻辑集成电路
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20页	384K
描述
700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER

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ICS8432DY-101LF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LQFP,	针数：	32
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.52	系列：	8432
输入调节：	DIFFERENTIAL MUX	JESD-30 代码：	S-PQFP-G32
JESD-609代码：	e3	长度：	7 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	湿度敏感等级：	3
功能数量：	1	反相输出次数：
端子数量：	32	实输出次数：	2
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	PLASTIC/EPOXY	封装代码：	LQFP
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
峰值回流温度（摄氏度）：	260	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.015 ns	座面最大高度：	1.6 mm
最大供电电压 (Vsup)：	3.465 V	最小供电电压 (Vsup)：	3.135 V
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	7 mm	最小 fmax：	700 MHz
Base Number Matches：	1

ICS8432DY-101LF 数据手册

700MHZ, DIFFERENTIAL-TO-3.3V

LVPECL FREQUENCY SYNTHESIZER

ICS8432-101

GENERAL DESCRIPTION

FEATURES

The ICS8432-101 is a general purpose, dual out-

• Dual differential 3.3V LVPECL outputs

ICS

HiPerClockS™

put Differential-to-3.3V LVPECL high frequency

• Selectable CLK, nCLK or LVCMOS/LVTTL TEST_CLK

synthesizer and a member of the HiPerClockS™

family of High Performance Clock Solutions from

ICS.The ICS8432-101 has a selectable TEST_CLK

• TEST_CLK can accept the following input levels:

LVCMOS or LVTTL

or CLK, nCLK inputs. The TEST_CLK input accepts LVCMOS

or LVTTL input levels and translates them to 3.3V LVPECL lev-

els. The CLK, nCLK pair can accept most standard differen-

tial input levels. The VCO operates at a frequency range of

250MHz to 700MHz. The VCO frequency is programmed in

steps equal to the value of the input differential or single ended

reference frequency. The VCO and output frequency can be

programmed using the serial or parallel interfaces to the con-

figuration logic. The low phase noise characteristics of the

ICS8432-101 makes it an ideal clock source for Gigabit Ethernet

and SONET applications.

• CLK, nCLK pair can accept the following differential

input levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL

• CLK, nCLK or TEST_CLK maximum input frequency: 40MHz

• Output frequency range: 25MHz to 700MHz

• VCO range: 250MHz to 700MHz

• Accepts any single-ended input signal on CLK input with

resistor bias on nCLK input

• Parallel interface for programming counter and output

dividers

• RMS period jitter: 5ps (maximum)

• Cycle-to-cycle jitter: 25ps (maximum)

• 3.3V supply voltage

• 0°C to 70°C ambient operating temperature

• Available in both standard (RoHS 5) and lead-free (RoHS 6)

packages

BLOCK DIAGRAM

PIN ASSIGNMENT

VCO_SEL

CLK_SEL

TEST_CLK

32 31 30 29 28 27 26 25

CLK

nCLK

CLK

TEST_CLK

CLK_SEL

V^CCA

ICS8432-101

S_LOAD

S_DATA

S_CLOCK

PLL

PHASE DETECTOR

V^EE

÷1

÷2

÷4

÷8

VCO

FOUT0

nFOUT0

FOUT1

nFOUT1

10 11 12 13 14 15 16

÷ M

S_LOAD

S_DATA

S_CLOCK

nP_LOAD

CONFIGURATION

INTERFACE

LOGIC

TEST

32-Lead LQFP

7mm x 7mm x 1.4mm package body

M0:M8

N0:N1

Y Package

Top View

IDT^™/ ICS^™700MHZ, 3.3V LVPECL FREQUENCY SYNTHESIZER

ICS8432DY-101 REV. C APRIL 10, 2007

12 3 4 5 6 7...20

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ICS8432DY-101LFT	IDT	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS8432DY-101T	ICSI	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS8432DY-101T	IDT	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS8432DYI-01	IDT	获取价格	Clock Generator, 700MHz, PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32
ICS8432DYI-01LF	IDT	获取价格	Clock Generator, 700MHz, PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32
ICS8432DYI-01LFT	IDT	获取价格	Clock Generator, 700MHz, PQFP32, 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32
ICS8432DYI-101	ICSI	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS8432DYI-101LF	ICSI	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS8432DYI-101LFT	ICSI	获取价格	700MHZ, DIFFERENTIAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER

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