HD49338HNP

更新时间： 2024-02-27 15:57:30

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瑞萨 - RENESAS		转换器模数转换器
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23页	259K
描述
CDS/PGA & 12-bit A/D Converter

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HD49338HNP 技术参数

生命周期：	Transferred	零件包装代码：	QFP
包装说明：	QFP-48	针数：	48
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.6
Is Samacsys：	N	转换器类型：	ADC, PROPRIETARY METHOD
JESD-30 代码：	S-XQCC-N48	长度：	7 mm
模拟输入通道数量：	1	位数：	12
功能数量：	1	端子数量：	48
最高工作温度：	75 °C	最低工作温度：	-10 °C
输出位码：	BINARY	输出格式：	PARALLEL, WORD
封装主体材料：	UNSPECIFIED	封装代码：	VQCCN
封装等效代码：	LCC48,.27SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, VERY THIN PROFILE	电源：	3 V
认证状态：	Not Qualified	采样并保持/跟踪并保持：	SAMPLE
座面最大高度：	0.8 mm	子类别：	Analog to Digital Converters
标称供电电压：	3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL EXTENDED
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	7 mm
Base Number Matches：	1

HD49338HNP 数据手册

HD49338NP/HNP

Absolute Maximum Ratings

(Ta = 25°C)

Item

Power supply voltage

Symbol

V_DD(max)

Ratings

4.1

Unit

Analog input voltage

V_IN(max)

V_I(max)

Topr

–0.3 to AV_DD+0.3

–0.3 to DV_DD+0.3

–10 to +75

400

Digital input voltage

Operating temperature

°C

Power dissipation

Pt(max)

Tstg

Storage temperature

–55 to +125

2.85 to 3.3

2.70 to 3.3

Power supply voltage range (HD49338HNP)

Power supply voltage range (HD49338NP)

Vopr

Notes: 1. V_DDindicates AV_DDand DV_DD

2. AV_DDand DV_DDmust be commonly connected outside the IC. When they are separated by a noise filter, the

potential difference must be 0.3 V or less at power on, and 0.1 V or less during operation.

Electrical Characteristics

(Unless othewide specified, Ta = 25°C, AV_DD= 3.0 V, DV_DD= 3.0 V, and R_BIAS= 33 kΩ)

•

Items Common to CDSIN and ADCIN Input Modes

Item

Symbol

Min

Typ

Max

Unit

Test Conditions

Remarks

Power supply voltage

range

V_DD

2.85

3.00

3.30

LoPwr = low

Conversion frequency

f_CLKlow

5.5

—

MHz

LoPwr = high

LoPwr = low

_CLKhi

DV_DD

Digital input voltage

V_IH

DV_DD

Digital input pins

other than CS,

2.0 ×

3.0

DV_DD

3.0

SCK and SDATA

V_IL

—

0.8 ×

DV_DD

3.0

V_IH2

V_IL2

DV_DD

CS, SCK, SDATA

2.25 ×

DV_DD

3.0

0.6 ×

Digital output voltage

Digital input current

V_OH

V_OL

I_IH

DV_DD–0.5

—

I_OH= –1 mA

I_OL= +1 mA

V_IH= 3.0 V

V_IL= 0 V

0.5

—

µA

bit

I_IH2

—

250

—

I_IL

–50

—

Digital output current

I_OZH

I_OZL

RES

INL

—

V_OH= V_DD

V_OL= 0 V

–50

—

ADC resolution

(8)

0.6

–0.6

ADC integral linearity

—

LSBp-p f_CLK= 20 MHz

ADC differential linearity+ DNL+

ADC differential linearity– DNL–

—

0.95

—

LSB

µA

f_CLK= 20 MHz

–0.95

–100

Sleep current

I_SLP

100

Digital input pin is

set to 0 V, output

pin is open

Standby current

I_STBY

—

Digital I/O pin is set

to 0 V

Digital output Hi-Z

delay time

t_HZ

t_LZ

t_ZH

t_ZL

—

100

R_L= 2 kΩ,

See figure 7

C_L= 10 pF

Notes: 1. Differential linearity is the calculated difference in linearity errors between adjacent codes.

2. Values within parentheses ( ) are for reference.

Rev.2.00 May 20, 2005 page 17 of 22

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