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HCS112DMSR PDF预览

HCS112DMSR

更新时间： 2024-01-18 06:16:08
品牌 Logo 应用领域
英特矽尔 - INTERSIL 触发器逻辑集成电路
页数 文件大小 规格书
9页 183K
描述
Radiation Hardened Dual JK Flip-Flop

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HCS112DMSR 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DFP包装说明：DFP, FL16,.3
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5.27
Is Samacsys：N系列：HC/UH
JESD-30 代码：R-CDFP-F16JESD-609代码：e0
负载电容（CL）：50 pF逻辑集成电路类型：J-K FLIP-FLOP
最大频率@ Nom-Sup：20000000 Hz位数：2
功能数量：2端子数量：16
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, METAL-SEALED COFIRED
封装代码：DFP封装等效代码：FL16,.3
封装形状：RECTANGULAR封装形式：FLATPACK
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
Prop。Delay @ Nom-Sup：35 ns传播延迟（tpd）：35 ns
认证状态：Not Qualified筛选级别：MIL-PRF-38535 Class V
座面最大高度：2.92 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Tin/Lead (Sn/Pb)端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED总剂量：200k Rad(Si) V
触发器类型：NEGATIVE EDGE宽度：6.73 mm
最小 fmax：20 MHzBase Number Matches：1

HCS112DMSR 数据手册

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HCS112MS  
Radiation Hardened  
Dual JK Flip-Flop  
September 1995  
Features  
Pinouts  
16 LEAD CERAMIC DUAL-IN-LINE  
METAL SEAL PACKAGE (SBDIP)  
MIL-STD-1835 CDIP2-T16, LEAD FINISH C  
TOP VIEW  
• 3 Micron Radiation Hardened SOS CMOS  
• Total Dose 200K RAD (Si)  
• SEP Effective LET No Upsets: >100 MEV-cm2/mg  
• Single Event Upset (SEU) Immunity < 2 x 10-9 Errors/  
Bit-Day (Typ)  
CP1  
KA  
1
2
3
4
5
6
7
8
16 VCC  
15 RA  
14 RB  
13 CPB  
12 KB  
11 JB  
• Dose Rate Survivability: >1 x 1012 RAD (Si)/s  
• Dose Rate Upset >1010 RAD (Si)/s 20ns Pulse  
• Latch-Up Free Under Any Conditions  
JA  
SA  
QA  
QA  
QB  
GND  
• Military Temperature Range: -55oC to +125oC  
• Significant Power Reduction Compared to LSTTL ICs  
• DC Operating Voltage Range: 4.5V to 5.5V  
10 SB  
9
QB  
• Input Logic Levels  
- VIL = 30% of VCC Max  
- VIH = 70% of VCC Min  
16 LEAD CERAMIC METAL SEAL  
FLATPACK PACKAGE (FLATPACK)  
MIL-STD-1835 CDFP4-F16, LEAD FINISH C  
TOP VIEW  
• Input Current Levels Ii ≤ 5µA at VOL, VOH  
Description  
CP1  
KA  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
VCC  
RA  
The Intersil HCS112MS is a Radiation Hardened dual JK  
flip-flop with set and reset. The output changes state on the  
negative going transition of the clock pulse. Set and reset  
are accomplished asynchronously by a logic low input level.  
JA  
RB  
SA  
CPB  
KB  
QA  
QA  
QB  
GND  
JB  
The HCS112MS utilizes advanced CMOS/SOS technology  
to achieve high-speed operation. This device is a member of  
radiation hardened, high-speed, CMOS/SOS Logic Family.  
SB  
QB  
The HCS112MS is supplied in a 16 lead Ceramic flatpack  
(K suffix) or a SBDIP Package (D suffix).  
Ordering Information  
PART NUMBER  
HCS112DMSR  
TEMPERATURE RANGE  
SCREENING LEVEL  
Intersil Class S Equivalent  
Intersil Class S Equivalent  
Sample  
PACKAGE  
16 Lead SBDIP  
o
o
-55 C to +125 C  
o
o
HCS112KMSR  
-55 C to +125 C  
16 Lead Ceramic Flatpack  
16 Lead SBDIP  
o
HCS112D/Sample  
HCS112K/Sample  
HCS112HMSR  
+25 C  
o
+25 C  
Sample  
16 Lead Ceramic Flatpack  
Die  
o
+25 C  
Die  
CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.  
Spec Number 518830  
File Number 3558.1  
1-888-INTERSIL or 321-724-7143 | Copyright © Intersil Corporation 1999  
11  
1234567...9

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与HCS112DMSR相关器件

型号 品牌 获取价格 描述 数据表
HCS112HMSR INTERSIL

获取价格

 		Radiation Hardened Dual JK Flip-Flop
HCS112K INTERSIL

获取价格

 		Radiation Hardened Dual JK Flip-Flop
HCS112KMSR INTERSIL

获取价格

 		Radiation Hardened Dual JK Flip-Flop
HCS112MS INTERSIL

获取价格

 		Radiation Hardened Dual JK Flip-Flop
HCS11DMSR ETC

获取价格

 		Triple 3-input AND Gate
HCS11KMSR ETC

获取价格

 		Triple 3-input AND Gate
HCS11MS INTERSIL

获取价格

 		Radiation Hardened Triple 3-Input AND Gate
HCS11MS RENESAS

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 		CMOS Triple 3-Input AND Gate
HCS11MSD RENESAS

获取价格

 		HC/UH SERIES, TRIPLE 3-INPUT AND GATE, CDIP14, WELD SEALED, CERAMIC, DIP-14
HCS11MSK RENESAS

获取价格

 		HC/UH SERIES, TRIPLE 3-INPUT AND GATE, CDFP14, WELD SEALED, CERAMIC, DFP-14

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