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DSP56007DS

更新时间： 2024-01-29 05:30:25
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其他 - ETC 数字信号处理器
页数 文件大小 规格书
83页 655K
描述
DSP56007 24-Bit Digital Signal Processor Data Sheet

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DSP56007DS 技术参数

生命周期：Obsolete包装说明：LQFP,
Reach Compliance Code：unknownECCN代码：3A001.A.3
HTS代码：8542.31.00.01风险等级：5.84
桶式移位器：NO边界扫描：NO
最大时钟频率：66 MHz格式：FIXED POINT
内部总线架构：MULTIPLEJESD-30 代码：S-PQFP-G80
长度：14 mm低功率模式：NO
端子数量：80封装主体材料：PLASTIC/EPOXY
封装代码：LQFP封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE认证状态：Not Qualified
座面最大高度：1.6 mm标称供电电压：5 V
表面贴装：YES技术：HCMOS
端子形式：GULL WING端子节距：0.65 mm
端子位置：QUAD宽度：14 mm
uPs/uCs/外围集成电路类型：DIGITAL SIGNAL PROCESSOR, OTHERBase Number Matches：1

DSP56007DS 数据手册

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Freescale Semiconductor, Inc.  
MOTOROLA  
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DSP56007/D  
SEMICONDUCTOR TECHNICAL DATA  
DSP56007  
SYMPHONY AUDIO DSP FAMILY  
24-BIT DIGITAL SIGNAL PROCESSORS  
Motorola designed the Symphony family of high-performance, programmable Digital Signal  
Processors (DSPs) to support a variety of digital audio applications, including Dolby ProLogic,  
ATRAC, and Lucasfilm Home THX processing. Software for these applications is licensed by  
Motorola for integration into products like audio/ video receivers, televisions, and automotive  
sound systems with such user-developed features as digital equalization and sound field  
processing. The DSP56007 is an MPU-style general purpose DSP, composed of an efficient 24-bit  
Digital Signal Processor core, program and data memories, various peripherals optimized for  
audio, and support circuitry. As illustrated in Figure 1, the DSP56000 core family compatible  
DSP is fed by program memory, two independent data RAMs and two data ROMs, a Serial  
Audio Interface (SAI), Serial Host Interface (SHI), External Memory Interface (EMI), dedicated  
I/ O lines, on-chip Phase Lock Loop (PLL), and On-Chip Emulation (OnCE ) port. The  
DSP56007 has significantly more on-chip memory than the DSP56004.  
ˇ
16-Bit Bus  
24-Bit Bus  
4
9
5
29  
General  
Purpose  
Input/  
Serial  
Serial  
External  
Audio  
Interface  
(SAI)  
Host  
Interface  
(SHI)  
Memory  
Interface  
(EMI)  
X Data  
Memory*  
Program  
Memory*  
Y Data  
Memory*  
Output  
PAB  
Address  
Generation  
Unit  
24-Bit  
DSP56000  
Core  
XAB  
YAB  
GDB  
PDB  
XDB  
YDB  
Internal  
Data  
Bus  
Switch  
TM  
OnCE Port  
Program  
Address  
Generator  
Program  
Decode  
Controller  
Data ALU  
24 × 24 + 56 → 56-Bit MAC  
Two 56-Bit Accumulators  
Interrupt  
Control  
Clock  
PLL  
Gen.  
Program Control Unit  
Refer to Table 1 for memory configurations.  
4
*
3
4
IRQA, IRQB, NMI, RESET  
AA0248  
Figure 1 DSP56007 Block Diagram  
©1996, 1997 MOTOROLA, INC.  
For More Information On This Product,  
Go to: www.freescale.com  
 
1234567...83

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型号 品牌 获取价格 描述 数据表
DSP56007ROM MOTOROLA

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