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DM5474J

更新时间： 2024-11-24 22:51:39
品牌 Logo 应用领域
美国国家半导体 - NSC 触发器锁存器逻辑集成电路
页数 文件大小 规格书
6页 124K
描述
Dual Positive-Edge-Triggered D Flip-Flops with Preset, Clear and Complementary Outputs

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DM5474J 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：CERAMIC, DIP-14Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.3
Is Samacsys：N系列：TTL/H/L
JESD-30 代码：R-GDIP-T14JESD-609代码：e0
长度：19.43 mm逻辑集成电路类型：D FLIP-FLOP
最大I（ol）：0.016 A位数：1
功能数量：2端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
输出极性：COMPLEMENTARY封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装等效代码：DIP14,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
最大电源电流（ICC）：30 mA传播延迟（tpd）：40 ns
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：TTL
温度等级：MILITARY端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.62 mm
最小 fmax：15 MHzBase Number Matches：1

DM5474J 数据手册

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June 1989  
5474/DM5474/DM7474  
Dual Positive-Edge-Triggered D Flip-Flops  
with Preset, Clear and Complementary Outputs  
General Description  
This device contains two independent positive-edge-trig-  
gered D flip-flops with complementary outputs. The informa-  
tion on the D input is accepted by the flip-flops on the posi-  
tive going edge of the clock pulse. The triggering occurs at a  
voltage level and is not directly related to the transition time  
of the rising edge of the clock. The data on the D input may  
be changed while the clock is low or high without affecting  
the outputs as long as the data setup and hold times are not  
violated. A low logic level on the preset or clear inputs will  
set or reset the outputs regardless of the logic levels of the  
other inputs.  
Features  
Y
Alternate Military/Aerospace device (5474) is available.  
Contact a National Semiconductor Sales Office/Distrib-  
utor for specifications.  
Connection Diagram  
Dual-In-Line Package  
TL/F/6526–1  
Order Number 5474DMQB, 5474FMQB, DM5474J, DM5474W, DM7474M or DM7474N  
See NS Package Number J14A, M14A, N14A or W14B  
Function Table  
Inputs  
CLR  
Outputs  
PR  
CLK  
D
Q
Q
L
H
L
H
L
X
X
X
X
X
H
L
H
L
L
H
L
X
H*  
H
H*  
L
H
H
H
H
H
H
u
u
L
L
H
X
Q
0
Q
0
e
e
e
H
X
L
High Logic Level  
Either Low or High Logic Level  
Low Logic Level  
e
e
Positive-going transition of the clock.  
This configuration is nonstable; that is, it will not persist when either the preset and/or clear  
inputs return to their inactive (high) level.  
u
*
e
Q
0
The output logic level of Q before the indicated input conditions were established.  
C
1995 National Semiconductor Corporation  
TL/F/6526  
RRD-B30M105/Printed in U. S. A.  
123456

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与DM5474J相关器件

型号 品牌 获取价格 描述 数据表
DM5474J/883 TI

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