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Datasheet > 电信电路 > 网络接口> CYV15G0403DXB-BGXI
CYV15G0403DXB-BGXI PDF预览

CYV15G0403DXB-BGXI

更新时间： 2024-02-20 10:45:46
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 时钟
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描述
Independent Clock Quad HOTLink II⑩ Transceiver

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CYV15G0403DXB-BGXI 数据手册

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CYP15G0403DXB  
CYV15G0403DXB  
CYW15G0403DXB  
Device Configuration and Control Block Diagram  
= Internal Signal  
RFMODE[A..D][1:0]  
RFEN[A..D]  
FRAMCHAR[A..D]  
DECMODE[A..D]  
RXBIST[A..D]  
WREN  
Device Configuration  
and Control Interface  
ADDR[3:0]  
RXCKSEL[A..D]  
DECBYP[A..D]  
RXRATE[A..D]  
SDASEL[2..1][A..D][1:0]  
RXPLLPD[A..D]  
TXRATE[A..D]  
TXCKSEL[A..D]  
PABRST[A..D]  
TXBIST[A..D]  
DATA[7:0]  
OE[2..1][A..D]  
ENCBYP[A..D]  
GLEN[11..0]  
FGLEN[2..0]  
Pin Configuration (Top View)  
1
2
3
4
5
6
7
8
9
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
A
B
C
D
IN  
C1–  
OUT  
C1–  
IN  
C2–  
OUT  
C2–  
IN  
D1–  
OUT  
D1–  
IN  
D2–  
OUT  
D2–  
IN  
A1–  
OUT  
A1–  
IN  
A2–  
OUT  
A2–  
IN  
B1–  
OUT  
B1–  
IN  
B2–  
OUT  
B2–  
V
GND  
GND  
V
CC  
CC  
CC  
CC  
CC  
CC  
CC  
CC  
IN  
C1+  
OUT  
C1+  
IN  
C2+  
OUT  
C2+  
IN  
D1+  
OUT  
D1+  
IN  
D2+  
OUT  
D2+  
IN  
A1+  
OUT  
A1+  
IN  
A2+  
OUT  
A2+  
IN  
B1+  
OUT  
B1+  
IN  
B2+  
OUT  
B2+  
V
V
V
GND  
GND  
GND  
GND  
GND  
GND  
V
V
V
TDI  
TMS INSELC INSELB  
ULCD ULCC  
DATA  
[7]  
DATA  
[5]  
DATA  
[3]  
DATA  
[1]  
NC  
SPD  
SELD  
LDTD TRST LPEND TDO  
EN  
TCLK RESET INSELD INSELA  
ULCA  
SPD  
SELC  
DATA  
[6]  
DATA  
[4]  
DATA  
[2]  
DATA  
[0]  
LPENB ULCB  
LPENA LTEN1 SCAN TMEN3  
EN2  
V
V
V
V
V
V
V
V
E
F
CC  
RX  
DC[6] DC[7] DC[0]  
TX TX  
CC  
CC  
CC  
CC  
CC  
RX  
STB[1] CLKOB STB[0]  
CC  
CC  
RX  
TX  
NC  
NC  
TX  
RX  
TX  
SPD  
SELB  
LP  
ENC  
SPD  
SELA DB[1]  
RX  
G
DC[7] WREN DC[4] DC[1]  
GND GND GND GND  
GND GND GND GND  
H
J
TX  
TX  
TX  
TX  
RX  
RX  
RX  
RX  
CTC[1] DC[5] DC[2] DC[3]  
STB[2] DB[0]  
DB[5]  
DB[2]  
RX REF TX TX  
DC[2] CLKC– CTC[0] CLKC  
RX  
DB[3]  
RX  
DB[4]  
RX  
DB[7]  
K
L
LFIB  
TX  
RX  
REF  
LFIC  
NC  
TX  
DC[6]  
RX  
RX  
RX  
DC[3] CLKC+  
DB[6] CLKB+ CLKB– DB[6]  
RX RX  
DC[4] DC[5]  
TX  
ERRC  
REF REF TX TX  
M
CLKB+ CLKB– ERRB CLKB  
GND GND GND GND  
GND GND GND GND  
N
P
RX RX RX RX  
TX  
DB[5]  
TX  
DB[4]  
TX  
DB[3]  
TX  
DB[2]  
DC[1] DC[0] STC[0] STC[1]  
RX TX RX RX  
STC[2] CLKOC CLKC+ CLKC–  
TX  
DB[1]  
TX  
TX  
TX  
R
DB[0] CTB[1] DB[7]  
V
V
V
V
V
V
V
V
T
CC  
CC  
CC  
CC  
CC  
CC  
CC  
CC  
U
TX  
TX  
TX  
TX  
RX  
RX  
TX  
CTA[1]  
ADDR  
[0]  
REF  
CLKD– DA[1]  
TX  
TX  
TX  
RX  
TX  
RX  
RX  
V
V
V
V
GND  
GND  
GND  
GND  
GND  
GND  
GND  
GND  
V
V
V
V
CC  
CC  
CC  
CC  
CC  
CC  
CC  
CC  
DD[0] DD[1] DD[2] CTD[1]  
DD[2] DD[1]  
DA[4] CTA[0]  
DA[2] CTB[0] STA[2] STA[1]  
V
W
Y
TX  
TX  
TX  
RX  
RX  
RX  
RX  
STD[2]  
ADDR  
[2]  
REF  
CLKD+ CLKOA  
TX  
TX  
DA[3]  
TX  
DA[7]  
RX  
DA[7]  
RX  
DA[3]  
RX  
RX  
DD[3] DD[4] CTD[0] DD[6]  
DD[3] STD[0]  
DA[0] STA[0]  
TX  
TX  
LFID  
RX  
RX  
CLKD–  
RX  
RX  
ADDR ADDR  
[3]  
RX  
TX  
TX  
DA[2]  
TX  
DA[6]  
LFIA  
REF  
CLKA+ DA[4]  
RX  
RX  
DA[1]  
DD[5] DD[7]  
DD[4] STD[1]  
[1]  
CLKA+ ERRA  
TX  
TX  
RX  
RX  
RX  
TX  
CLKOD  
NC  
TX  
RX  
TX  
DA[0]  
TX  
DA[5]  
TX  
REF RX  
RX  
DA[5]  
DD[6] CLKD DD[7] CLKD+  
DD[5] DD[0]  
CLKA CLKA–  
ERRD CLKA– DA[6]  
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