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CYW134SOXC PDF预览

CYW134SOXC

更新时间： 2024-11-28 03:10:43
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 晶体时钟发生器微控制器和处理器外围集成电路光电二极管
页数 文件大小 规格书
12页 208K
描述
Direct Rambus⑩ Clock Generator

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CYW134SOXC 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SSOP包装说明：SSOP, SSOP24,.24
针数：24Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.5Is Samacsys：N
JESD-30 代码：R-PDSO-G24JESD-609代码：e4
长度：8.6487 mm湿度敏感等级：3
端子数量：24最高工作温度：70 °C
最低工作温度：最大输出时钟频率：400 MHz
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装等效代码：SSOP24,.24封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH电源：3.3 V
主时钟/晶体标称频率：100 MHz认证状态：Not Qualified
座面最大高度：1.7526 mm子类别：Clock Generators
最大压摆率：100 mA最大供电电压：3.465 V
最小供电电压：3.135 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL宽度：3.8989 mm
uPs/uCs/外围集成电路类型：CLOCK GENERATOR, PROCESSOR SPECIFICBase Number Matches：1

CYW134SOXC 数据手册

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W134M/W134S  
Direct Rambus™ Clock Generator  
Features  
Description  
• Differential clock source for Direct Rambus™ memory  
subsystem for up to 800-MHz data transfer rate  
The Cypress W134M/W134S provides the differential clock  
signals for a Direct Rambus memory subsystem. It includes  
signals to synchronize the Direct Rambus Channel clock to an  
external system clock but can also be used in systems that do  
not require synchronization of the Rambus clock.  
• Provide synchronization flexibility: the Rambus®  
Channel can optionally be synchronous to an external  
system or processor clock  
• Power-managed output allows Rambus Channel clock  
to be turned off to minimize power consumption for  
mobile applications  
• WorkswithCypressCY2210, W133, W158, W159, W161,  
and W167 to support Intel® architecture platforms  
• Low-power CMOS design packaged in a 24-pin QSOP  
(150-mil SSOP) package  
Block Diagram  
Pin Configuration  
REFCLK  
MULT0:1  
VDDIR  
REFCLK  
VDD  
GND  
GND  
PCLKM  
SYNCLKN  
GND  
1
2
3
4
5
6
7
8
9
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
S0  
S1  
VDD  
GND  
CLK  
PLL  
NC  
CLKB  
GND  
VDD  
MULT0  
MULT1  
GND  
CLK  
Output  
Logic  
Phase  
PCLKM  
CLKB  
Alignment  
VDD  
SYNCLKN  
VDDIPD  
STOPB  
PWRDNB  
10  
11  
12  
Test  
S0:1  
Logic  
STOPB  
Cypress Semiconductor Corporation  
•
3901 North First Street  
•
San Jose, CA 95134  
•
408-943-2600  
Document #: 38-07426 Rev. *C  
Revised June 1, 2005  
1234567...12

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型号 品牌 获取价格 描述 数据表
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