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CY7C186-20ZC PDF预览

CY7C186-20ZC

更新时间： 2024-11-14 00:01:31
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 存储内存集成电路静态存储器光电二极管
页数 文件大小 规格书
9页 160K
描述
8Kx8 Static RAM

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CY7C186-20ZC 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：TSOP1包装说明：8 X 20 MM, TSOP1-32
针数：32Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.32.00.41
风险等级：5.89Is Samacsys：N
最长访问时间：20 ns其他特性：AUTOMATIC POWER-DOWN
I/O 类型：COMMONJESD-30 代码：R-PDSO-G32
JESD-609代码：e0长度：18.4 mm
内存密度：65536 bit内存集成电路类型：STANDARD SRAM
内存宽度：8功能数量：1
端子数量：32字数：8192 words
字数代码：8000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：8KX8输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：TSOP1
封装等效代码：TSSOP32,.8,20封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE并行/串行：PARALLEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified座面最大高度：1.2 mm
最大待机电流：0.015 A最小待机电流：4.5 V
子类别：SRAMs最大压摆率：0.11 mA
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：8 mm
Base Number Matches：1

CY7C186-20ZC 数据手册

 浏览型号CY7C186-20ZC的Datasheet PDF文件第2页浏览型号CY7C186-20ZC的Datasheet PDF文件第3页浏览型号CY7C186-20ZC的Datasheet PDF文件第4页浏览型号CY7C186-20ZC的Datasheet PDF文件第5页浏览型号CY7C186-20ZC的Datasheet PDF文件第6页浏览型号CY7C186-20ZC的Datasheet PDF文件第7页 
86  
CY7C186  
8Kx8 Static RAM  
provided by an active LOW chip enable (CE1), an active HIGH  
chip enable (CE2), and active LOW output enable (OE) and  
three-state drivers. The device has an automatic power-down  
feature (CE1), reducing the power consumption by over 80%  
when deselected. The CY7C186 is in a 600-mil-wide PDIP  
package and a 32-pin TSOP (std. pinout).  
Features  
• High speed  
— 20 ns  
• Low active power  
An active LOW write enable signal (WE) controls the writ-  
ing/reading operation of the memory. When CE1 and WE in-  
puts are both LOW and CE2 is HIGH, data on the eight data  
input/output pins (I/O0 through I/O7) is written into the memory  
location addressed by the address present on the address  
pins (A0 through A12). Reading the device is accomplished by  
selecting the device and enabling the outputs, CE1 and OE  
active LOW, CE2 active HIGH, while WE remains inactive or  
HIGH. Under these conditions, the contents of the location ad-  
dressed by the information on address pins are present on the  
eight data input/output pins.  
— 605 mW  
• Low standby power  
— 110 mW  
• CMOS for optimum speed/power  
• Easy memory expansion with CE1, CE2, and OE  
features  
• TTL-compatible inputs and outputs  
• Automatic power-down when deselected  
The input/output pins remain in a high-impedance state unless  
the chip is selected, outputs are enabled, and write enable  
(WE) is HIGH. A die coat is used to insure alpha immunity.  
Functional Description  
The CY7C186 is a high-performance CMOS static RAM orga-  
nized as 8192 words by 8 bits. Easy memory expansion is  
Pin Configuration  
LogicBlock Diagram  
DIP  
Top View  
V
CC  
WE  
NC  
1
28  
27  
26  
25  
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
A
4
2
A5  
A6  
A7  
3
CE2  
I/O  
A3  
4
0
A2  
5
INPUT BUFFER  
A
A1  
8
6
I/O  
1
A9  
OE  
7
A0  
A
10  
8
A
CE1  
I/O7  
I/O6  
I/O5  
I/O4  
I/O3  
A
11  
9
I/O  
1
2
A
12  
I/O0  
I/O  
10  
11  
12  
13  
14  
A
2
A
I/O  
3
3
A
256 x 32 x 8  
ARRAY  
I/O12  
4
A
GND  
5
I/O  
A
4
6
A
7
I/O  
A
5
8
I/O  
6
POWER  
DOWN  
CE  
CE  
1
2
I/O  
COLUMN DECODER  
7
WE  
OE  
Selection Guide[1]  
7C186-20  
20  
7C186-25  
25  
7C186-35  
35  
Maximum Access Time (ns)  
Maximum Operating Current (mA)  
110  
100  
100  
Maximum Standby Current (mA)  
20/15  
20/15  
20/15  
Notes:  
1. For military specifications, see the CY7C186A datasheet.  
Cypress Semiconductor Corporation  
Document #: 38-05280 Rev. **  
•
3901 North First Street  
•
San Jose  
•
CA 95134  
•
408-943-2600  
Revised March 22, 2002  
1234567...9

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与CY7C186-20ZC相关器件

型号 品牌 获取价格 描述 数据表
CY7C186-20ZCT CYPRESS

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 		Standard SRAM, 8KX8, 20ns, CMOS, PDSO32, 8 X 20 MM, TSOP1-32
CY7C186-25 CYPRESS

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 		8Kx8 Static RAM
CY7C186-25DC CYPRESS

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 		Standard SRAM, 8KX8, 25ns, CMOS, CDIP28, CERDIP-28
CY7C186-25DMB CYPRESS

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 		Standard SRAM, 8KX8, 25ns, CMOS, CDIP28,
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 		Standard SRAM, 8KX8, 45ns, CMOS, CDIP28,

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