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CY7C09199-9AC

更新时间： 2024-11-07 05:09:31

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赛普拉斯 - CYPRESS		/
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19页	337K
描述
64K/128K x 8/9 Synchronous Dual-Port Static RAM

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CY7C09199-9AC 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	QFP	包装说明：	PLASTIC, TQFP-100
针数：	100	Reach Compliance Code：	not_compliant
ECCN代码：	3A991.B.2.A	HTS代码：	8542.32.00.41
风险等级：	5.84	最长访问时间：	20 ns
其他特性：	FLOW-THROUGH OR PIPELINED ARCHITECTURE	最大时钟频率 (fCLK)：	67 MHz
I/O 类型：	COMMON	JESD-30 代码：	S-PQFP-G100
JESD-609代码：	e0	长度：	14 mm
内存密度：	1179648 bit	内存集成电路类型：	DUAL-PORT SRAM
内存宽度：	9	湿度敏感等级：	3
功能数量：	1	端口数量：	2
端子数量：	100	字数：	131072 words
字数代码：	128000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	128KX9	输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	LFQFP
封装等效代码：	QFP100,.63SQ,20	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	240	电源：	5 V
认证状态：	Not Qualified	座面最大高度：	1.6 mm
最大待机电流：	0.0005 A	最小待机电流：	4.5 V
子类别：	SRAMs	最大压摆率：	0.35 mA
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	30	宽度：	14 mm
Base Number Matches：	1

CY7C09199-9AC 数据手册

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CY7C09089/99

CY7C09189/99

64K/128K x 8/9

Synchronous Dual-Port Static RAM

• Low operating power

Features

—Active = 195 mA (typical)

• True dual-ported memory cells which allow simulta-

neous access of the same memory location

—Standby = 0.05 mA (typical)

• Fully synchronous interface for easier operation

• Burst counters increment addresses internally

—Shorten cycle times

• Six Flow-Through/Pipelined devices

— 64K x 8/9 organizations (CY7C09089/189)

— 128K x 8/9 organizations (CY7C09099/199)

• Three Modes

—Minimize bus noise

—Supported in Flow-Through and Pipelined modes

• Dual Chip Enables for easy depth expansion

• Automatic power-down

• Commercial and Industrial temperature ranges

• Available in 100-pin TQFP

— Flow-Through

— Pipelined

— Burst

• Pipelined output mode on both ports allows fast 100-

MHz cycle time

• Pin-compatibleandfunctionallyequivalenttoIDT70908

and IDT709089

• 0.35-micron CMOS for optimum speed/power

• High-speed clock to data access 6.5^[1]/7.5/9/12 ns

(max.)

Logic Block Diagram

R/W_L

OE_L

R/W_R

OE_R

CE_0L

CE_0R

CE_1L

CE_1R

0/1

FT/Pipe_L

FT/Pipe_R

[2]

8/9

I/O_0L–I/O_7/8L

I/O_0R–I/O_7/8R

I/O

Control

16/17

[3]

A₀–A_15/16L

A₀–A

15/16R

Counter/

Address

Decode

Counter/

Address

Decode

CLK_L

CLK_R

True Dual-Ported

RAM Array

ADS_L

ADS_R

CNTEN_L

CNTRST_L

CNTEN_R

CNTRST_R

Notes:

1. See page 7 for Load Conditions.

2. I/O₀–I/O₇for x8 devices; I/O₀–I/O₈for x9 devices.

3. A₀–A₁₅for 64K; and A₀–A₁₆for 128K devices.

For the most recent information, visit the Cypress web site at www.cypress.com

Cypress Semiconductor Corporation

•

3901 North First Street

•

San Jose

•

CA 95134

•

408-943-2600

Document #: 38-06039 Rev. *A

Revised December 27, 2002

12 3 4 5 6 7...19

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型号	品牌	获取价格	描述	数据表
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CY7C09199V	CYPRESS	获取价格	3.3V 32K/64K/128K x 8/9 Synchronous Dual-Port Static RAM
CY7C09199V-10AC	CYPRESS	获取价格	Multi-Port SRAM, 128KX9, 10ns, CMOS, PQFP100, PLASTIC, TQFP-100
CY7C09199V-12AC	CYPRESS	获取价格	3.3V 32K/64K/128K x 8/9 Synchronous Dual-Port Static RAM
CY7C09199V-12AXC	CYPRESS	获取价格	3.3V 32K/64K/128K x 8/9 Synchronous Dual-Port Static RAM
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CY7C09199V-6AXC	CYPRESS	获取价格	3.3V 32K/64K/128K x 8/9 Synchronous Dual-Port Static RAM
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