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CY7C09179V-7AC

更新时间： 2024-02-25 09:29:59
品牌 Logo 应用领域
赛普拉斯 - CYPRESS /
页数 文件大小 规格书
18页 335K
描述
3.3V 32K/64K/128K x 8/9 Synchronous Dual-Port Static RAM

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CY7C09179V-7AC 技术参数

生命周期：Obsolete零件包装代码：QFP
包装说明：LFQFP,针数：100
Reach Compliance Code：unknownECCN代码：3A991.B.2.B
HTS代码：8542.32.00.41风险等级：5.79
最长访问时间：18 ns其他特性：FLOW-THROUGH OR PIPELINED ARCHITECTURE
JESD-30 代码：S-PQFP-G100长度：14 mm
内存密度：294912 bit内存集成电路类型：DUAL-PORT SRAM
内存宽度：9功能数量：1
端子数量：100字数：32768 words
字数代码：32000工作模式：SYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：32KX9封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH并行/串行：PARALLEL
认证状态：Not Qualified座面最大高度：1.6 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD宽度：14 mm
Base Number Matches：1

CY7C09179V-7AC 数据手册

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CY7C09079V/89V/99V  
CY7C09179V/89V/99V  
Electrical Characteristics Over the Operating Range  
CY7C09079V/89V/99V  
CY7C09179V/89V/99V  
-6[1]  
-7[1]  
-9  
-12  
Parameter  
Description  
VOH  
Output HIGH Voltage (VCC = Min. 2.4  
IOH = –4.0 mA)  
2.4  
2.0  
2.4  
2.0  
2.4  
2.0  
V
V
VOL  
Output LOW Voltage (VCC = Min.  
IOH = +4.0 mA)  
0.4  
0.8  
0.4  
0.8  
0.4  
0.8  
0.4  
0.8  
VIH  
VIL  
IOZ  
ICC  
Input HIGH Voltage  
Input LOW Voltage  
2.0  
V
V
Output Leakage Current  
–10  
10 –10  
175 320  
10 –10  
10 –10  
10 µA  
Operating Current  
Com’l.  
155 275  
275 390  
135 225  
185 295  
115 205 mA  
mA  
(VCC=Max. IOUT =0 mA)  
Outputs Disabled  
Ind.[11]  
ISB1  
ISB2  
ISB3  
Standby Current (Both  
Ports TTL Level)[12] CEL  
& CER ≥ VIH, f = fMAX  
Com’l.  
Ind.[11]  
25  
95  
25  
85  
20  
35  
65  
75  
20  
50 mA  
mA  
85 120  
Standby Current (One  
Port TTL Level)[12] CEL |  
CER ≥ VIH, f = fMAX  
Com’l.  
Ind.[11]  
115 175  
10 250  
105 165  
165 210  
95 150  
105 160  
85 140 mA  
mA  
Standby Current (Both  
Ports CMOS Level)[12]  
CEL & CER ≥ VCC – 0.2V,  
f = 0  
Com’l.  
Ind.[11]  
10 250  
10 250  
10 250  
10 250  
10 250 µA  
µA  
ISB4  
Standby Current (One  
Port CMOS Level)[12]  
CEL | CER ≥ VIH, f = fMAX  
Com’l.  
Ind.[11]  
105 135  
95 125  
125 170  
85 115  
95 125  
75 100 mA  
mA  
Capacitance  
Parameter  
Description  
Input Capacitance  
Output Capacitance  
Test Conditions  
Max.  
10  
Unit  
pF  
CIN  
TA = 25°C, f = 1 MHz,  
CC = 3.3V  
V
COUT  
10  
pF  
Note:  
12. CEL and CER are internal signals. To select either the left or right port, both CE0 AND CE1 must be asserted to their active states (CE0 ≤ VIL and CE1 ≥ VIH).  
Document #: 38-06043 Rev. *A  
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