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CV133PAG

更新时间： 2024-09-21 19:48:59

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
26页	140K
描述
Processor Specific Clock Generator, 400MHz, PDSO56, GREEN, TSSOP-56

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CV133PAG 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	TSSOP, TSSOP56,.3,20
针数：	56	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.81	JESD-30 代码：	R-PDSO-G56
JESD-609代码：	e3	长度：	14 mm
湿度敏感等级：	1	端子数量：	56
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	400 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP56,.3,20
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
主时钟/晶体标称频率：	14.31818 MHz	认证状态：	Not Qualified
座面最大高度：	1.1 mm	子类别：	Clock Generators
最大压摆率：	400 mA	最大供电电压：	3.465 V
最小供电电压：	3.135 V	标称供电电压：	3.3 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	6.1 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

CV133PAG 数据手册

IDTCV133

COMMERCIALTEMPERATURERANGE

PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR

PROGRAMMABLE FLEXPC

CLOCK FOR P4 PROCESSOR

IDTCV133

DESCRIPTION:

FEATURES:

IDTCV133is a 56pinclockdevice, incorporatingbothIntelCK410Mand

CKSSCD requirements, for Intel advance P4 processors. The CPU output

bufferisdesignedtosupportupto400MHzprocessor. ThischiphasfourPLLs

insideforCPU,SRC/PCI,LVDS,and48MHz/DOT96IOclocks. Thisdevice

alsoimplementsBand-gapreferencedIREFtoreducetheimpactofVDDvariation

ondifferentialoutputs,whichcanprovidemorerobustsystemperformance.

EachCPU/SRC/LVDShasitsownSpreadSpectrumselection.

• Power management control suitable for notebook applications

• One high precision PLL for CPU, SSC and N programming

• One high precision PLL for SRC/PCI, supports 100MHz output

frequency, SSC and N programming

• One high precision PLL for LVDS. Supports 100/96MHz output

frequency, SSC programming

• One high precision PLL for 96MHz/48MHz

• Band-gap circuit for differential outputs

• Support spread spectrum modulation, –0.5 down spread and

others

• Support SMBus block read/write, index read/write

• Selectable output strength for REF

• Allows for CPU frequency to change to a slower frequency to

conserve power when an application is less execution-

intensive

OUTPUTS:

• 2*0.7V current –mode differential CPU CLK pair

• 5*0.7V current –mode differential SRC CLK pair

• One CPU_ITP/SRC selectable CLK pair

• 6*PCI, 2 free running, 33.3MHz

• 1*96MHz,1*48MHz

• Smooth transition for N programming

• Available in TSSOP package

• 1*REF

• One 100/96 MHz differential LVDS

KEYSPECIFICATION:

• CPU CLK cycle to cycle jitter < 100ps

• SRC CLK cycle to cycle jitter < 125ps

• PCI CLK cycle to cycle jitter < 500ps

FUNCTIONALBLOCKDIAGRAM

PLL1

SSC

N Programmable

CPU[1:0]

CPU CLK

Output Buffer

Stop Logic

CPU_ITP/SRC7

IREF

XTAL

Osc Amp

REF

ITP_EN

LVDS CLK

Output Buffer

Stop Logic

PLL2

SSC

LVDS

SDATA

SCLK

SM Bus

Controller

IREF

SRC CLK

Output Buffer

Stop Logic

PLL3

SSC

N Programmable

SRC[5:1]

VTT_PWRGD#/PD

SEL100/96#

CLKREQA#

CLKREQB#

FSA.B.C

PCI[3:0], PCIF[1:0]

IREF

SEL

100/96MHz

48MHz

DOT96

Control

Logic

PLL4

48MHz/96MHz

Output BUffer

PCI_STOP#

CPU_STOP#

TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.

COMMERCIAL TEMPERATURE RANGE

JANUARY 2005

DSC 6564/14

12 3 4 5 6 7...26

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型号	品牌	获取价格	描述	数据表
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CV136PAG	IDT	获取价格	Processor Specific Clock Generator, 400MHz, PDSO56, GREEN, TSSOP-56
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CV137PA8	IDT	获取价格	Clock Generator, PDSO56
CV137PAG	IDT	获取价格	Processor Specific Clock Generator, 400MHz, PDSO56, GREEN, TSSOP-56
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CV141PVG8	IDT	获取价格	PLL Based Clock Driver, 141 Series, 8 True Output(s), 0 Inverted Output(s), PDSO48, GREEN,
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