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CDCLVD2108RGZR PDF预览

CDCLVD2108RGZR

更新时间： 2024-11-26 12:55:11
品牌 Logo 应用领域
德州仪器 - TI /
页数 文件大小 规格书
20页 778K
描述
Dual 1:8 Low Additive Jitter LVDS Buffer

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CDCLVD2108RGZR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN, LCC48,.27SQ,20针数：48
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.44系列：CDC
输入调节：DIFFERENTIALJESD-30 代码：S-PQCC-N48
JESD-609代码：e4长度：7 mm
逻辑集成电路类型：LOW SKEW CLOCK DRIVER湿度敏感等级：3
功能数量：2反相输出次数：
端子数量：48实输出次数：8
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装等效代码：LCC48,.27SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE包装方法：TR
峰值回流温度（摄氏度）：260电源：2.5 V
Prop。Delay @ Nom-Sup：2.5 ns传播延迟（tpd）：2.5 ns
认证状态：Not QualifiedSame Edge Skew-Max（tskwd）：0.08 ns
座面最大高度：1 mm子类别：Clock Drivers
最大供电电压 (Vsup)：2.625 V最小供电电压 (Vsup)：2.375 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mm最小 fmax：800 MHz
Base Number Matches：1

CDCLVD2108RGZR 数据手册

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CDCLVD2108  
www.ti.com  
SCAS905C –OCTOBER 2010–REVISED DECEMBER 2010  
Dual 1:8 Low Additive Jitter LVDS Buffer  
Check for Samples: CDCLVD2108  
1
FEATURES  
DESCRIPTION  
•
Dual 1:8 Differential Buffer  
•
Low Additive Jitter <300 fs RMS in  
10 kHz to 20 MHz  
The CDCLVD2108 clock buffer distributes two clock  
inputs (IN0, IN1) to a total of 16 pairs of differential  
LVDS clock outputs (OUT0, OUT15). Each buffer  
block consists of one input and 8 LVDS outputs. The  
inputs can either be LVDS, LVPECL, or LVCMOS.  
•
•
Low Within Bank Output Skew of 50 ps (Max)  
Universal Inputs Accept LVDS, LVPECL,  
LVCMOS  
The CDCLVD2108 is specifically designed for driving  
50-Ω transmission lines. In case of driving the inputs  
in single ended mode, the appropriate bias voltage  
(VAC_REF) should be applied to the unused negative  
input pin.  
•
•
One Input Dedicated for Eight Outputs  
Total of 16 LVDS Outputs, ANSI EIA/TIA-644A  
Standard Compatible  
•
•
•
Clock Frequency up to 800 MHz  
2.375–2.625V Device Power Supply  
Using the control pin (EN) outputs can be either  
disabled or enabled. If the EN pin is left open all  
outputs are active, if switched to a logical '0' all  
outputs are disabled (static logical 0), if switched to a  
logical '1', OUT (8..15) are switched off and OUT  
(0..7) are active. The part supports a fail safe  
function. It incorporates an input hysteresis, which  
prevents random oscillation of the outputs in absence  
of an input signal.  
LVDS Reference Voltage, VAC_REF, Available for  
Capacitive Coupled Inputs  
•
•
•
Industrial Temperature Range –40°C to 85°C  
Packaged in 7mm × 7mm 48-Pin QFN (RGZ)  
ESD Protection Exceeds 3 kV HBM, 1 kV CDM  
APPLICATIONS  
The device operates in 2.5V supply environment and  
is characterized from –40°C to 85°C (ambient  
temperature). The CDCLVD2108 is packaged in  
small 48-pin, 7-mm x 7-mm QFN package.  
•
•
•
•
•
Telecommunications/Networking  
Medical Imaging  
Test and Measurement Equipment  
Wireless Communications  
General Purpose Clocking  
200 MHz  
PHY 8  
Clock  
Generator  
EN  
CDCLVD2108  
100 MHz  
PHY16  
Figure 1. Application Example  
1
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
Copyright © 2010, Texas Instruments Incorporated  
 
 
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CDCLVD2108RGZR 替代型号

型号 品牌 替代类型 描述 数据表
CDCLVD2108RGZT TI

完全替代

 Dual 1:8 Low Additive Jitter LVDS Buffer

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型号 品牌 获取价格 描述 数据表
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