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CD4078BKMSR

更新时间： 2024-10-26 19:40:51

品牌	Logo	应用领域
瑞萨 - RENESAS		输入元件
页数	文件大小	规格书
8页	66K
描述
4000/14000/40000 SERIES, 8-INPUT OR/NOR GATE, CDFP14, CERAMIC, DFP-14

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CD4078BKMSR 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	DFP	包装说明：	DFP, FL14,.3
针数：	14	Reach Compliance Code：	not_compliant
HTS代码：	8542.39.00.01	风险等级：	5.75
系列：	4000/14000/40000	JESD-30 代码：	R-CDFP-F14
JESD-609代码：	e0	长度：	9.585 mm
负载电容（CL）：	50 pF	逻辑集成电路类型：	OR/NOR GATE
最大频率@ Nom-Sup：	3000000 Hz	最大I（ol）：	0.00036 A
功能数量：	1	输入次数：	8
端子数量：	14	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	DFP	封装等效代码：	FL14,.3
封装形状：	RECTANGULAR	封装形式：	FLATPACK
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	5/15 V
Prop。Delay @ Nom-Sup：	405 ns	传播延迟（tpd）：	405 ns
认证状态：	Not Qualified	施密特触发器：	NO
筛选级别：	MIL-PRF-38535 Class V	座面最大高度：	5.33 mm
子类别：	Gates	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	FLAT	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
总剂量：	100k Rad(Si) V	宽度：	6.285 mm
Base Number Matches：	1

CD4078BKMSR 数据手册

CD4078BMS

CMOS 8 Input NOR/OR Gate

December 1992

CD4078BMS

TOP VIEW

Features

• High Voltage Type (20V Rating)

Pinout

• Medium Speed Operation

K **

14 VDD

13 J *

12 H

- tPHL, tPLH = 75ns (Typ.) at VDD = 10V

• Buffered Inputs and Output

• 5V, 10V and 15V Parametric Ratings

• Standardized, Symmetrical Output Characteristics

• 100% Tested for Quiescent Current at 20V

11 G

10 F

VSS

• Maximum Input Current of 1µA at 18V Over Full Pack-

age Temperature Range; 100nA at 18V and +25^oC

• Noise Margin (Over Full Package/Temperature Range)

- 1V at VDD = 5V

**^{K = A + B + C + D + E + F + G + H}

J = A + B + C + D + E + F + G + H

NC = NO CONNECTION

- 2V at VDD = 10V

- 2.5V at VDD = 15V

Functional Diagram

• Meets All Requirements of JEDEC Tentative Standard

No. 13B, “Standard Speciﬁcations for Description of

‘B’ Series CMOS Devices”

Description

CD4078BMS NOR/OR Gate provides the system designer with

direct implementation of the positive logic 8 input NOR and OR

functions and supplements the existing family of CMOS gates.

The CD4078BMS is supplied in these 14 lead outline packages:

J = A + B + C + D + E + F + G + H

K = A + B + C + D + E + F + G + H

6, 8 = NO CONNECTION

VDD = 14

Braze Seal DIP

Frit Seal DIP

H4Q

H1B

Ceramic Flatpack H3W

VSS = 7

Logic Diagram

FIGURE 1. LOGIC DIAGRAM

CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.

File Number 3326

7-1038

12 3 4 5 6 7 8

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型号	品牌	获取价格	描述	数据表
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