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C9824CY

更新时间： 2024-02-03 14:06:48

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		光电二极管外围集成电路
页数	文件大小	规格书
17页	323K
描述
Processor Specific Clock Generator, CMOS, PDSO56, SSOP-56

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C9824CY 技术参数

生命周期：	Obsolete	零件包装代码：	SSOP
包装说明：	SSOP,	针数：	56
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.84
JESD-30 代码：	R-PDSO-G56	JESD-609代码：	e0
长度：	18.415 mm	端子数量：	56
封装主体材料：	PLASTIC/EPOXY	封装代码：	SSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, SHRINK PITCH
认证状态：	Not Qualified	座面最大高度：	2.794 mm
表面贴装：	YES	技术：	CMOS
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.635 mm	端子位置：	DUAL
宽度：	7.5 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, PROCESSOR SPECIFIC
Base Number Matches：	1

C9824CY 数据手册

+/+…when timing is critical

C9824C

Low EMI Clock Generator for Intel 133MHz/3 DIMM Chipset Systems

Preliminary

Group Timing Relationships and Tolerances

CPU = 66.6 MHz, SDRAM = 100 MHz

Offset (nS)

Tolerance (pS)

Conditions

CPU to SDRAM

CPU to 3V66

2.5

7.5

500

180 degrees phase shift

When rising edges line-up

3V66 leads

SDRAM to 3V66

3V66 to PCI

500

1.5-3.5

500

PCI to IOAPIC

1000

CPU = 100 MHz, SDRAM = 100 MHz

Offset (nS)

Tolerance (pS)

Conditions

CPU to SDRAM

CPU to 3V66

500

1000

180 degrees phase shift

SDRAM to 3V66

3V66 to PCI

1.5-3.5

When rising edges line-up

3V66 leads

PCI to IOAPIC

CPU = 133.3 MHz, SDRAM = 100 MHz

Offset (nS)

Tolerance (pS)

Conditions

CPU to SDRAM

CPU to 3V66

500

1000

When rising edges line-up

SDRAM to 3V66

3V66 to PCI

1.5-3.5

When rising edges line-up

3V66 leads

PCI to IOAPIC

CPU = 133.3 MHz, SDRAM = 133.3 MHz

Offset (nS)

Tolerance (pS)

Conditions

CPU to SDRAM

CPU to 3V66

3.75

500

1000

180 degrees phase shift

SDRAM to 3V66

3V66 to PCI

3.75

1.5-3.5

3V66 leads

PCI to IOAPIC

INTERNATIONAL MICROCIRCUITS, INC. 525 LOS COCHES ST.,

MILPITAS, CA 95035, USA TEL: 408-263-6300, FAX 408-263-6571

http://www.imicorp.com

Rev 1.1

3/12/2000

Page 5 of 17

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