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ATF1500ABV-12JC

更新时间： 2024-11-06 22:05:15
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爱特美尔 - ATMEL /
页数 文件大小 规格书
12页 296K
描述
High- Performance EE PLD

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ATF1500ABV-12JC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：LCC包装说明：PLASTIC, LCC-44
针数：44Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.57
其他特性：NO最大时钟频率：62.5 MHz
系统内可编程：NOJESD-30 代码：S-PQCC-J44
JESD-609代码：e0JTAG BST：NO
长度：16.5862 mm湿度敏感等级：2
专用输入次数：I/O 线路数量：32
宏单元数：32端子数量：44
最高工作温度：70 °C最低工作温度：
组织：0 DEDICATED INPUTS, 32 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC44,.7SQ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：225
电源：3/5 V可编程逻辑类型：FLASH PLD
传播延迟：12 ns认证状态：Not Qualified
座面最大高度：4.57 mm子类别：Programmable Logic Devices
最大供电电压：5.5 V最小供电电压：2.7 V
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：16.5862 mm
Base Number Matches：1

ATF1500ABV-12JC 数据手册

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Features  
• Operates Between 2.7V to 5.5V  
• High Density, High-Performance Electrically Erasable Complex  
Programmable Logic Device  
– 44-Pin, 32 I/O CPLD  
– 12 ns Maximum Pin-to-Pin Delay  
– Registered Operation Up To 90.9 MHz  
– Fully Connected Input and Feedback Logic Array  
• Flexible Logic Macrocell  
– D/T/Latch Configurable Flip Flops  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
• Advanced Power Management Features  
– Automatic 3 mA Stand-By (ATF1500ABVL)  
– Pin-Controlled 5 µA Stand-By Mode (Typical)  
– Programmable Pin-Keeper Inputs and I/Os  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 44-Pin PLCC and TQFP Packages  
• Advanced Flash Technology  
High-  
Performance  
EE PLD  
ATF1500ABV  
ATF1500ABVL  
– 100% Tested  
– Completely Reprogrammable  
– 100 Program/Erase Cycles  
– 20 Year Data Retention  
– 2000V ESD Protection  
– 200 mA Latch-Up Immunity  
• Supported By Popular 3rd Party Tools  
• Security Fuse Feature  
Description  
The ATF1500ABV is a high performance, high density Complex PLD. Built on an  
advanced Flash technology, it has maximum pin to pin delays of 12 ns and supports  
sequential logic operation at speeds up to 90.9 MHz. With 32 logic macrocells and up  
to 36 inputs, it easily integrates logic from several TTL, SSI, MSI and classic PLDs.  
The ATF1500ABV’s global input and feedback architecture simplifies logic placement  
and eliminates pinout changes due to design changes.  
(continued)  
Pin Configurations  
PLCC  
Top View  
TQFP  
Pin  
Name  
Function  
Clock  
Top View  
CLK  
I
I N D E X  
C O R N E R  
Logic Inputs  
Bidirectional  
Buffers  
4 4 4 2 4 0  
3 6 3 4  
3 8  
I/O  
4 3 4 1 3 9 3 7 3 5  
I / O  
I / O  
I / O  
I / O  
I / O  
I / O  
I / O  
G N D  
I / O  
I / O  
I / O  
I / O  
V C C  
I / O  
I / O  
1
3 3  
3 2  
3 1  
3 0  
2 9  
2
3
4
5
6
7
8
9
Register Reset  
(active low)  
GCLR  
V C C  
I / O  
I / O  
I / O  
2 8  
2 7  
2 6  
2 5  
2 4  
2 3  
OE1,  
OE2  
Output Enable  
(active low)  
I / O  
G N D  
I / O  
1 0  
1 1  
(+3V to 5.25V)  
Supply  
1 3 1 5 1 7 1 9 2 1  
1 6  
VCC  
PD  
1 8 2 0 2 2  
1 2 1 4  
Rev. 0723D–6/98  
Power Down  
(active high)  
1234567...12

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