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ATF1500ABV-15AJ

更新时间： 2024-02-16 09:14:43
品牌 Logo 应用领域
爱特美尔 - ATMEL 时钟输入元件可编程逻辑
页数 文件大小 规格书
15页 317K
描述
Flash PLD, 15ns, CMOS, PQFP44, 1 MM HEIGHT, PLASTIC, TQFP-44

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ATF1500ABV-15AJ 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：QFP包装说明：TQFP,
针数：44Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.76
最大时钟频率：52.6 MHzJESD-30 代码：S-PQFP-G44
JESD-609代码：e3长度：10 mm
湿度敏感等级：3专用输入次数：
I/O 线路数量：32端子数量：44
最高工作温度：85 °C最低工作温度：-40 °C
组织：0 DEDICATED INPUTS, 32 I/O输出函数：MACROCELL
封装主体材料：PLASTIC/EPOXY封装代码：TQFP
封装形状：SQUARE封装形式：FLATPACK, THIN PROFILE
峰值回流温度（摄氏度）：260可编程逻辑类型：FLASH PLD
传播延迟：15 ns认证状态：Not Qualified
座面最大高度：1.2 mm最大供电电压：5.5 V
最小供电电压：2.7 V标称供电电压：3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.8 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：10 mmBase Number Matches：1

ATF1500ABV-15AJ 数据手册

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Features  
• Operates between 2.7V to 5.5V  
• High-density, High-performance Electrically-erasable Complex  
Programmable Logic Device  
– 44-pin, 32 I/O CPLD  
– 100% connected  
– 12 ns Maximum Pin-to-pin Delay  
– Registered Operation up to 90.9 MHz  
– Fully Connected Input and Feedback Logic Array  
• Flexible Logic Macrocell  
– D/T/Latch Configurable Flip-flops  
– Global and Individual Register Control Signals  
– Global and Individual Output Enable  
– Programmable Output Slew Rate  
• Advanced Power Management Features  
– Pin-controlled 5 µA Standby Mode (Typical)  
– Programmable Pin-keeper Inputs and I/Os  
• Available in Commercial and Industrial Temperature Ranges  
• Available in 44-lead PLCC and TQFP Packages  
• Advanced EEPROM Technology  
– 100% Tested  
High-  
performance  
EE PLD  
ATF1500ABV  
– Completely Reprogrammable  
– 10,000 Program/Erase Cycles  
– 20-year Data Retention  
– 2000V ESD Protection  
– 200 mA Latchup Immunity  
• Supported by Popular Third-party Tools  
• Security Fuse Feature  
Description  
The ATF1500ABV is a high-performance, high-density complex PLD. Built on an  
advanced EEPROM technology, it has maximum pin-to-pin delays of 12 ns and sup-  
ports sequential logic operation at speeds up to 90.9 MHz. With 32 logic macrocells  
and up to 36 inputs, it easily integrates logic from several TTL, SSI, MSI and classic  
PLDs.  
Pin Configurations  
Pin  
PLCC  
Top View  
TQFP  
Top View  
Name  
CLK  
I
Function  
Clock  
Logic Inputs  
I/O  
I/O  
I/O  
7
8
9
39 I/O  
38 I/O  
37 I/O  
36 I/O  
35 VCC  
34 I/O  
33 I/O  
32 I/O  
31 I/O  
30 GND  
29 I/O  
I/O  
I/O  
1
2
3
4
5
6
7
8
9
33 I/O  
32 I/O  
31 I/O  
30 I/O  
29 VCC  
28 I/O  
27 I/O  
26 I/O  
25 I/O  
24 GND  
23 I/O  
I/O  
Bi-directional  
Buffers  
I/O  
GND 10  
I/O 11  
I/O 12  
I/O 13  
I/O 14  
VCC 15  
I/O 16  
I/O 17  
GND  
I/O  
GCLR  
Register Reset  
(active low)  
I/O  
I/O  
I/O  
VCC  
OE1,  
OE2  
Output Enable  
(active low)  
I/O 10  
I/O 11  
VCC  
(+3V to 5.25V)  
Supply  
PD  
Power-down  
(active high)  
Rev. 0723I–08/01  
1234567...15

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