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AS80SSTVF16859-56KR

更新时间: 2024-10-30 20:19:31
品牌 Logo 应用领域
PULSECORE 逻辑集成电路触发器电视
页数 文件大小 规格书
13页 122K
描述
D Flip-Flop, SSTV Series, 1-Func, Positive Edge Triggered, 13-Bit, True Output, MLF2-56

AS80SSTVF16859-56KR 技术参数

生命周期:Obsolete包装说明:HVQCCN,
Reach Compliance Code:unknown风险等级:5.7
Is Samacsys:N系列:SSTV
JESD-30 代码:S-XQCC-N56JESD-609代码:e0
长度:8 mm逻辑集成电路类型:D FLIP-FLOP
位数:13功能数量:1
端子数量:56最高工作温度:70 °C
最低工作温度:输出极性:TRUE
封装主体材料:UNSPECIFIED封装代码:HVQCCN
封装形状:SQUARE封装形式:CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度(摄氏度):NOT SPECIFIED传播延迟(tpd):2.8 ns
认证状态:Not Qualified座面最大高度:1 mm
最大供电电压 (Vsup):2.7 V最小供电电压 (Vsup):2.3 V
标称供电电压 (Vsup):2.5 V表面贴装:YES
温度等级:COMMERCIAL端子面层:TIN LEAD
端子形式:NO LEAD端子节距:0.5 mm
端子位置:QUAD处于峰值回流温度下的最长时间:NOT SPECIFIED
触发器类型:POSITIVE EDGE宽度:8 mm
最小 fmax:270 MHzBase Number Matches:1

AS80SSTVF16859-56KR 数据手册

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August 2003  
Advance Information  
PulseC re AS80SSTVF16859  
&
DDR 13-Bit to 26-Bit Registered Buffer  
Recommended Applications  
Features  
DDR memory modules: PC1600, PC2100,  
PC2700, AND PC3200  
Provides complete DDR DIMM logic solution with  
PCV857  
Differential clock signals  
Meets SSTL_2 class II specifications on outputs  
Low voltage operation – V = 2.3 V to 2.7 V  
DD  
Available in 64-pin TSSOP and 56-pin VFQFN  
packages (MLF2)  
SSTL_2-compatible data registers  
Block Diagram  
Pin Configurations  
Q13A  
Q12A  
Q11A  
Q10A  
Q9A  
VDDQ  
GND  
D13  
1
2
64  
63  
CLK  
CLKB  
3
4
5
62  
61  
60  
D12  
VDD  
VDDQ  
GND  
D11  
Q1A  
Q1B  
RESETB  
6
7
59  
58  
VDDQ  
GND  
Q8A  
R
CLK  
D1  
VREF  
8
57  
D1  
9
56  
Q7A  
D10  
10  
11  
12  
13  
55  
54  
53  
52  
Q6A  
D9  
Q5A  
GND  
D8  
Q4A  
Q3A  
D7  
To 12 other channels  
Q2A  
RESETB  
14  
15  
16  
17  
18  
19  
20  
21  
22  
23  
24  
25  
26  
27  
28  
29  
30  
31  
32  
51  
50  
49  
48  
GND  
Q1A  
GND  
CLKB  
CLK  
Q13B  
VDDQ  
Q12B  
Q11B  
Q10B  
Q9B  
Q7A  
Q6A  
1
42 D10  
D9  
47  
46  
45  
44  
43  
42  
41  
40  
39  
38  
37  
36  
35  
34  
33  
VDDQ  
VDD  
VREF  
D6  
Q5A  
D8  
Q4A  
D7  
RESETB  
Q3A  
GND  
D5  
D4  
Q2A  
GND  
CLKB  
CLK  
VDDQ  
VDD  
VREF  
D6  
Q8B  
Q1A  
AS80SSTVF16859  
Q7B  
Q13B  
VDDQ  
Q12B  
Q11B  
Q10B  
Q9B  
Q6B  
D3  
GND  
VDDQ  
Q5B  
GND  
VDDQ  
VDD  
D2  
D5  
Q4B  
14  
29  
Q8B  
D4  
Q3B  
D1  
Q2B  
GND  
Q1B  
VDDQ  
64-Pin TSSOP  
6.10 mm body, 0.50 mm pitch  
56-Pin VFQFN (MLF2)  
8/6/03; v.0.10  
Alliance Semiconductor  
P. 1 of 13  
ꢀꢁꢂꢃꢄꢅꢆꢇꢈꢉ'ꢉꢊꢋꢋꢅꢌꢍꢎꢏꢉꢐꢏꢑꢅꢎꢁꢍꢒꢓꢎꢈꢁꢄꢔꢉꢊꢋꢋꢉꢄꢅꢆꢇꢈꢕꢉꢄꢏꢕꢏꢄꢖꢏꢒꢔ  

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