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AM79C031AJC

更新时间： 2024-10-29 00:00:47
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页数 文件大小 规格书
49页 688K
描述
Dual Subscriber Line Audio Processing Circuit (DSLAC) Devices

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AM79C031AJC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：QFJ包装说明：QCCJ, LDCC32,.5X.6
针数：32Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.8
压伸定律：A-LAW滤波器：YES
JESD-30 代码：R-PQCC-J32JESD-609代码：e0
长度：13.97 mm线性编码：16-BIT
负电源额定电压：-5 V功能数量：1
端子数量：32最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装等效代码：LDCC32,.5X.6
封装形状：RECTANGULAR封装形式：CHIP CARRIER
电源：+-5 V认证状态：Not Qualified
座面最大高度：3.556 mm子类别：Codecs
标称供电电压：5 V表面贴装：YES
技术：CMOS电信集成电路类型：SLIC
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD宽度：11.43 mm
Base Number Matches：1

AM79C031AJC 数据手册

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Am79C02/03/031(A)  
Dual Subscriber Line Audio Processing Circuit (DSLAC™) Devices  
DISTINCTIVE CHARACTERISTICS  
GENERAL DESCRIPTION  
■ Software programmable:  
— SLIC impedance  
The Am79C02/03/031(A) Dual Subscriber Line Audio  
Processing Circuit (DSLAC device) integrates the key  
functions of an analog linecard into a single high-per-  
formance, programmable dual codec/filter device. The  
DSLAC device is based on the proven design of the  
reliable Am7901A Subscriber Line Audio Processing  
Circuit (SLAC™ device). The advanced architecture of  
the DSLAC device implements two independent chan-  
nels and employs digital filters to allow software control  
of transmission, thus providing a cost effective solution  
for the analog to PCM function of a linecard.  
— Transhybrid balance  
— Transmit and receive gains  
— Equalization  
— Digital I/O pins  
— Time Slot Assigner  
— PCM transmit clock edge options  
■ Adaptive transhybrid balance filter  
(A suffix only)  
The Am79C02/03/031(A) DSLAC device’s advanced  
CMOS technology makes this an economical device  
that has both the functionality and the low power con-  
sumption needed in linecard designs to maximize line-  
card density at minimum cost. When used with two AMD  
SLICs, the DSLAC device provides software config-  
urable solutions to the BORSCHT function.  
■ A-law or µ-law coding  
■ Dual PCM ports  
— Up to 8.192 MHz each (128 channels per port)  
■ 2.048 MHz or 4.096 MHz master clock  
■ Direct transformer drive  
■ Built-in test modes  
■ Low power CMOS  
■ Mixed mode (analog and digital) impedance  
scaling  
■ Performance characteristics guaranteed over  
12 dB gain range  
Publication# 09875 Rev: J Amendment: /0  
Issue Date: December 1999  
1234567...49

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型号 品牌 获取价格 描述 数据表
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