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ADUC7028

更新时间: 2024-10-29 11:16:15
品牌 Logo 应用领域
亚德诺 - ADI 控制器微控制器
页数 文件大小 规格书
92页 978K
描述
精密模拟微控制器,12位模拟I/O,ARM7TDMI® MCU

ADUC7028 数据手册

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ADuC7019/20/21/22/24/25/26/27  
TIMING SPECIFICATIONS  
Table 2. External Memory Write Cycle  
Parameter  
Min  
Typ  
Max  
Unit  
CLK  
UCLK  
TMS_AFTER_CLKH  
TADDR_AFTER_CLKH  
TAE_H_AFTER_MS  
TAE  
THOLD_ADDR_AFTER_AE_L  
THOLD_ADDR_BEFORE_WR_L  
TWR_L_AFTER_AE_L  
TDATA_AFTER_WR_L  
TWR  
TWR_H_AFTER_CLKH  
THOLD_DATA_AFTER_WR_H  
TBEN_AFTER_AE_L  
TRELEASE_MS_AFTER_WR_H  
0
4
4
8
ns  
ns  
½ CLK  
(XMxPAR[14:12] + 1) x CLK  
½ CLK + (!XMxPAR[10]) x CLK  
(!XMxPAR[8]) x CLK  
½ CLK + (!XMxPAR[10] + !XMxPAR[8]) x CLK  
8
0
12  
4
ns  
ns  
(XMxPAR[7:4] + 1) x CLK  
(!XMxPAR[8]) x CLK  
½ CLK  
(!XMxPAR[8] + 1) x CLK  
CLK  
CLK  
T
MS_AFTER_CLKH  
MS  
AE  
T
WR_L_AFTER_AE_L  
T
AE_H_AFTER_MS  
T
WR  
T
RELEASE_MS_AFTER_WR_H  
T
AE  
T
WR_H_AFTER_CLKH  
WR  
RD  
T
HOLD_DATA_AFTER_WR_H  
T
HOLD_ADDR_AFTER_AE_L  
T
HOLD_ADDR_BEFORE_WR_L  
T
T
ADDR_AFTER_CLKH  
DATA_AFTER_WR_L  
5678  
A/D[15:0]  
FFFF  
9ABC  
9ABE  
1234  
T
BEN_AFTER_AE_L  
BEN0  
BEN1  
A16  
Figure 3. External Memory Write Cycle  
Rev. A | Page 9 of 92  
 

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