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ADC1251CIJ

更新时间： 2024-01-18 00:44:46
品牌 Logo 应用领域
美国国家半导体 - NSC 转换器
页数 文件大小 规格书
16页 302K
描述
Self-Calibrating 12-Bit Plus Sign A/D Converter with Sample-and-Hold

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ADC1251CIJ 技术参数

生命周期：Obsolete包装说明：DIP,
Reach Compliance Code：unknownECCN代码：3A001.A.2.C
HTS代码：8542.39.00.01风险等级：5.82
最大模拟输入电压：5.55 V最小模拟输入电压：-4.55 V
最长转换时间：15.65 µs转换器类型：ADC, SUCCESSIVE APPROXIMATION
JESD-30 代码：R-GDIP-T24最大线性误差 (EL)：0.0244%
标称负供电电压：-5 V模拟输入通道数量：1
位数：12功能数量：1
端子数量：24最高工作温度：125 °C
最低工作温度：-55 °C输出位码：BINARY
输出格式：PARALLEL, WORD封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DIP封装形状：RECTANGULAR
封装形式：IN-LINE认证状态：Not Qualified
采样并保持/跟踪并保持：SAMPLE筛选级别：MIL-STD-883
座面最大高度：4.572 mm标称供电电压：5 V
表面贴装：NO技术：CMOS
温度等级：MILITARY端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
宽度：15.24 mmBase Number Matches：1

ADC1251CIJ 数据手册

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Converter Electrical Characteristics (Continued)  
b
e
3.5 MHz unless otherwise specified. Boldface limits apply for T  
e
e a  
e b  
e a  
e
The following specifications apply for V  
e
(Notes 6, 7 and 8)  
DV  
CC  
AV  
5.0V, V  
e
5.0V, V  
to T  
5.0V, AZ  
; all other limits T  
‘‘1’’ and f  
CLK  
CC  
CC  
REF  
e
e
e
T
J
T
T
MIN  
25 C.  
§
A
J
MAX  
A
Typical  
Limit  
Units  
(Note 9) (Notes 10, 19) (Limit)  
Symbol  
Parameter  
Conditions  
DYNAMIC CHARACTERISTICS  
a
a
e
e
e
e
e
4.85 V  
IN p-p  
S/(N D) Unipolar Signal-to-Noise Distortion  
Ratio (Note 17)  
f
IN  
f
IN  
f
IN  
f
IN  
1 kHz, V  
72  
72  
dB  
dB  
e
20 kHz, V  
IN  
4.85 V  
p-p  
a
a
e
g
1 kHz, V  
IN  
S/(N D) Bipolar Signal-to-Noise Distortion  
Ratio (Note 17)  
4.85V  
76  
dB  
e
g
20 kHz, V  
4.85V  
76  
dB  
IN  
b
b
e
3 dB Unipolar Full Power Bandwidth  
3 dB Bipolar Full Power Bandwidth  
V
4.85V, (Note 17)  
32  
kHz  
kHz  
ns  
IN  
IN  
e
g
V
4.85V, (Note 17)  
25  
t
Aperture Time  
Aperture Jitter  
100  
100  
Ap  
ps  
rms  
Digital and DC Electrical Characteristics  
5.0V, V  
b
e
otherwise specified. Boldface limits apply for T  
e a  
e b  
e a  
; all other limits T  
e
CLK  
§
The following specifications apply for DV  
CC  
AV  
5.0V, V  
REF  
5.0V, and f  
3.5 MHz unless  
e
T 25 C. (Notes 6 and 7)  
J
CC  
e
e
e
T
J
T
to T  
A
MIN  
MAX  
A
Typical  
(Note 9)  
Limit  
Units  
Symbol  
Parameter  
Conditions  
(Notes 10, 19)  
(Limit)  
e
e
V
Logical ‘‘1’’ Input Voltage for  
All Inputs except CLK IN  
V
5.25V  
4.75V  
IN(1)  
IN(0)  
IN(1)  
CC  
2.0  
V(min)  
V(max)  
V
Logical ‘‘0’’ Input Voltage for  
All Inputs except CLK IN  
V
CC  
0.8  
1
e
I
I
Logical ‘‘1’’ Input Current  
Logical ‘‘0’’ Input Current  
V
V
5V  
0.005  
mA(max)  
mA(max)  
IN  
e
b
b
1
0V  
0.005  
2.8  
IN(0)  
IN  
a
V
V
V
V
CLK IN Positive-Going  
Threshold Voltage  
T
2.7  
2.3  
0.4  
V(min)  
V(max)  
V(min)  
b
CLK IN Negative-Going  
Threshold Voltage  
T
2.1  
0.7  
CLK IN Hysteresis  
b
H
a
b
[
]
V
(min)  
V
T
(max)  
T
e
4.75V:  
e b  
e b  
Logical ‘‘1’’ Output Voltage  
V
OUT(1)  
CC  
OUT  
OUT  
I
I
360 mA  
10 mA  
2.4  
4.5  
V(min)  
V(min)  
e
e
V
I
Logical ‘‘0’’ Output Voltage  
V
4.75V,  
1.6 mA  
OUT(0)  
CC  
0.4  
V(max)  
I
OUT  
e
OUT  
b
b
3
TRI-STATE Output Leakage  
É
Current  
V
0V  
5V  
0V  
5V  
0.01  
mA(max)  
mA(max)  
mA(min)  
mA(min)  
mA(max)  
mA(max)  
mA(max)  
OUT  
e
e
e
V
0.01  
3
OUT  
OUT  
OUT  
b
b
I
I
Output Source Current  
Output Sink Current  
V
20  
6.0  
SOURCE  
SINK  
V
20  
8.0  
e
e
e
DI  
DV Supply Current  
CC  
CS  
CS  
CS  
‘‘1’’  
‘‘1’’  
‘‘1’’  
1
4
2.5  
10  
10  
CC  
AI  
AV Supply Current  
CC  
CC  
Ib  
Vb Supply Current  
2.8  
3
1234567...16

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