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AD9874ABSTRL

更新时间： 2024-01-28 06:54:37
品牌 Logo 应用领域
亚德诺 - ADI 电信信息通信管理电信集成电路
页数 文件大小 规格书
41页 747K
描述
Low Power IF Digitizing Subsystem

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AD9874ABSTRL 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：LFQFP, QFP48,.35SQ,20针数：48
Reach Compliance Code：compliantECCN代码：5A991.B.7
HTS代码：8542.39.00.01风险等级：0.63
JESD-30 代码：S-PQFP-G48JESD-609代码：e3
长度：7 mm湿度敏感等级：3
功能数量：1端子数量：48
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP48,.35SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：3/3.3,3/5 V认证状态：Not Qualified
座面最大高度：1.6 mm子类别：Other Telecom ICs
标称供电电压：3 V表面贴装：YES
技术：BICMOS电信集成电路类型：TELECOM CIRCUIT
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：7 mmBase Number Matches：1

AD9874ABSTRL 数据手册

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AD9874  
PIN CONFIGURATION  
42 41 40  
48 47 46 45 44 43  
39 38 37  
MXOP  
MXON  
GNDF  
IF2N  
1
2
3
4
5
6
7
8
9
GNDL  
FREF  
GNDS  
SYNCB  
GNDH  
FS  
36  
35  
34  
33  
32  
31  
30  
29  
28  
27  
26  
25  
PIN 1  
IDENTIFIER  
IF2P  
AD9874  
VDDF  
GCP  
TOP VIEW  
DOUTB  
DOUTA  
CLKOUT  
VDDH  
VDDD  
PE  
(Not to Scale)  
GCN  
VDDA  
GNDA 10  
11  
VREFP  
VREFN 12  
13 14 15 16 17 18 19 20 21 22 23 24  
PIN FUNCTION DESCRIPTIONS  
Pin Mnemonic Description  
Pin Mnemonic Description  
1
2
3
4
5
6
7
8
MXOP  
MXON  
GNDF  
IF2N  
IF2P  
VDDF  
GCP  
Mixer Output, Positive.  
Mixer Output, Negative.  
27  
28  
29  
30  
VDDH  
Positive Power Supply for Digital Interface.  
Clock Output for SSI Port.  
Data Output for SSI Port.  
Data Output for SSI Port (Inverted) or  
SPI Port.  
Frame Sync for SSI Port.  
Ground for Digital Interface.  
Resets SSI and Decimator Counters;  
Active Low.  
Substrate Ground.  
Reference Frequency Input for Both  
Synthesizers.  
Ground for LO Synthesizer.  
Ground for LO Synthesizer Charge Pump.  
LO Synthesizer Charge Pump Output  
Current Charge Pump.  
Positive Power Supply for LO Synthesizer  
Charge Pump.  
CLKOUT  
DOUTA  
DOUTB  
Ground for Front End of ADC.  
Second IF Input (to ADC), Negative.  
Second IF Input (to ADC), Positive.  
Positive Power Supply for Front End of ADC.  
Filter Capacitor for ADC Full-Scale Control.  
Full-Scale Control Ground.  
Positive Power Supply for ADC Back End.  
Ground for ADC Back End.  
Voltage Reference, Positive.  
Voltage Reference, Negative.  
Reference Resistor: Requires 100 kΩ to  
GNDA.  
Positive Power Supply for Clock Synthesizer.  
Clock Synthesizer Charge Pump Output  
Current.  
31  
32  
33  
FS  
GNDH  
SYNCB  
GCN  
9
VDDA  
GNDA  
VREFP  
VREFN  
RREF  
34  
35  
GNDS  
FREF  
10  
11  
12  
13  
36  
37  
38  
GNDL  
GNDP  
IOUTL  
14  
15  
VDDQ  
IOUTC  
39  
VDDP  
40  
41  
VDDL  
CXVM  
Positive Power Supply for LO Synthesizer.  
External Filter Capacitor; DC Output of  
LNA.  
LO Input to Mixer and LO Synthesizer,  
Negative.  
LO Input to Mixer and LO Synthesizer,  
Positive.  
External Bypass Capacitor for LNA Power  
Supply.  
Ground for Mixer and LNA.  
External Capacitor for Mixer V-I Con-  
verter Bias.  
First IF Input (to LNA).  
16  
GNDQ  
Ground for Clock Synthesizer Charge  
Pump.  
Positive Power Supply for Clock Synthesizer.  
Ground for Clock Synthesizer.  
Sampling Clock Input/Clock VCO Tank,  
Positive.  
Sampling Clock Input/Clock VCO Tank,  
Negative.  
17  
18  
19  
VDDC  
GNDC  
CLKP  
42  
43  
44  
LON  
LOP  
20  
CLKN  
CXVL  
21  
22  
23  
24  
25  
26  
GNDS  
GNDD  
PC  
PD  
PE  
Substrate Ground.  
45  
46  
GNDI  
CXIF  
Ground for Digital Functions.  
Clock Input for SPI Port.  
Data I/O for SPI Port.  
Enable Input for SPI Port.  
Positive Power Supply for Internal Digital  
Function.  
47  
48  
IFIN  
VDDI  
Positive Power Supply for LNA and Mixer.  
VDDD  
–6–  
REV. A  
1...45678910...41

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