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AD7172-2BRUZ

更新时间： 2024-01-10 14:50:14
品牌 Logo 应用领域
亚德诺 - ADI 光电二极管转换器
页数 文件大小 规格书
61页 1139K
描述
True rail-to-rail analog and reference input buffers

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AD7172-2BRUZ 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active包装说明：TSSOP,
针数：24Reach Compliance Code：compliant
风险等级：2.29最大模拟输入电压：2.5 V
最小模拟输入电压：-2.5 V转换器类型：ADC, DELTA-SIGMA
JESD-30 代码：R-PDSO-G24长度：7.8 mm
最大线性误差 (EL)：0.0005%模拟输入通道数量：4
位数：24功能数量：1
端子数量：24最高工作温度：105 °C
最低工作温度：-40 °C输出位码：BINARY, OFFSET BINARY
输出格式：SERIAL封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：NOT SPECIFIED
采样速率：0.03125 MHz座面最大高度：1.2 mm
标称供电电压：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：4.4 mm
Base Number Matches：1

AD7172-2BRUZ 数据手册

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Data Sheet  
AD7172-2  
Parameter  
Test Conditions/Comments  
Min  
Typ  
Max  
Unit  
EXTERNAL REFERENCE INPUTS  
Differential Input Range  
Absolute Voltage Limits1  
Input Buffers Disabled  
Input Buffers Enabled  
REFIN Input Current  
Input Buffers Disabled  
Input Current  
VREF = (REF+) − (REF−)  
1
2.5  
AVDD1  
V
AVSS − 0.05  
AVSS  
AVDD1 + 0.05  
AVDD1  
V
V
9
µA/V  
Input Current Drift  
External clock  
Internal clock  
100  
0.75  
pA/V/°C  
nA/V/°C  
Input Buffers Enabled  
Input Current  
100  
nA  
Input Current Drift  
Normal Mode Rejection1  
Common-Mode Rejection  
TEMPERATURE SENSOR  
Accuracy  
0.25  
nA/°C  
See the Rejection parameter  
After user calibration at 25°C  
95  
dB  
2
°C  
Sensitivity  
477  
µV/K  
BURNOUT CURRENTS  
Source/Sink Current  
GPIO (GPIO0, GPIO1)  
Analog input buffers must be enabled  
With respect to AVSS  
10  
µA  
Input Mode Leakage  
Current1  
Floating State Output  
Capacitance  
Output High Voltage, VOH  
Output Low Voltage, VOL  
−10  
+10  
µA  
pF  
5
1
ISOURCE = 200 µA  
ISINK = 800 µA  
AVSS + 4  
AVSS + 3  
V
V
V
V
1
AVSS + 0.4  
AVSS + 0.7  
1
Input High Voltage, VIH  
Input Low Voltage, VIL  
1
CLOCK  
Internal Clock  
Frequency  
Accuracy  
2
MHz  
%
%
V
V
−2.5%  
+2.5%  
0.4  
Duty Cycle  
50  
Output Low Voltage, VOL  
Output High Voltage, VOH  
Crystal  
0.8 × IOVDD  
14  
Frequency  
16  
10  
2
16.384  
MHz  
µs  
MHz  
%
Startup Time  
External Clock (CLKIO)  
Duty Cycle1  
2.048  
70  
30  
50  
LOGIC INPUTS  
Input High Voltage, VINH  
1
2 V ≤ IOVDD < 2.3 V  
2.3 V ≤ IOVDD ≤ 5.5 V  
2 V ≤ IOVDD < 2.3 V  
2.3 V ≤ IOVDD ≤ 5.5 V  
IOVDD ≥ 2.7 V  
0.65 × IOVDD  
0.7 × IOVDD  
V
V
V
V
V
V
µA  
1
Input Low Voltage, VINL  
0.35 × IOVDD  
0.7  
0.25  
0.2  
+10  
Hysteresis1  
0.08  
0.04  
−10  
IOVDD < 2.7 V  
Leakage Currents  
Rev. A | Page 5 of 60  
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