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AD7172-2BRUZ

更新时间： 2024-02-05 04:02:55

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亚德诺 - ADI		光电二极管转换器
页数	文件大小	规格书
61页	1139K
描述
True rail-to-rail analog and reference input buffers

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AD7172-2BRUZ 技术参数

是否无铅：	含铅	是否Rohs认证：	符合
生命周期：	Active	包装说明：	TSSOP,
针数：	24	Reach Compliance Code：	compliant
风险等级：	2.29	最大模拟输入电压：	2.5 V
最小模拟输入电压：	-2.5 V	转换器类型：	ADC, DELTA-SIGMA
JESD-30 代码：	R-PDSO-G24	长度：	7.8 mm
最大线性误差 (EL)：	0.0005%	模拟输入通道数量：	4
位数：	24	功能数量：	1
端子数量：	24	最高工作温度：	105 °C
最低工作温度：	-40 °C	输出位码：	BINARY, OFFSET BINARY
输出格式：	SERIAL	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	NOT SPECIFIED
采样速率：	0.03125 MHz	座面最大高度：	1.2 mm
标称供电电压：	3.3 V	表面贴装：	YES
温度等级：	INDUSTRIAL	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	4.4 mm
Base Number Matches：	1

AD7172-2BRUZ 数据手册

AD7172-2

Data Sheet

SPECIFICATIONS

AVDD1 = 3.0 V to 5.5 V, AVDD2 = IOVDD = 2 V to 5.5 V, AVSS = DGND = 0 V, REF+ = 2.5 V, REF− = AVSS,

MCLK = internal master clock = 2 MHz, T_A= T_MINto T_MAX(−40°C to +105°C), unless otherwise noted.

Table 1.

Parameter

Test Conditions/Comments

Min

Typ

Max

Unit

ADC SPEED AND PERFORMANCE

Output Data Rate (ODR)

No Missing Codes¹

Resolution

1.25

31,250

SPS

Bits

Excluding sinc3 filter ≥ 15 kSPS

See Table 6 and Table 7

Noise

See Table 6 and Table 7

ACCURACY

Integral Nonlinearity (INL)

Offset Error²

Offset Drift

Gain Error²

ppm of FSR

µV

nV/°C

ppm of FSR

ppm/°C

Internal short

AVDD1 = 5 V

0.5

Gain Drift

0.2

REJECTION

Power Supply Rejection

Common-Mode Rejection

At DC

AVDD1, AVDD2, V_IN= 1 V

V_IN= 0.1 V

120

At 50 Hz, 60 Hz¹

20 Hz output data rate (postfilter), 50 Hz

1 Hz and 60 Hz 1 Hz

50 Hz 1 Hz and 60 Hz 1 Hz

Normal Mode Rejection¹

Internal clock, 20 SPS ODR (postfilter)

External clock, 20 SPS ODR (postfilter)

ANALOG INPUTS

Differential Input Range

Absolute Voltage Limits¹

Input Buffers Disabled

Input Buffers Enabled

Analog Input Current

Input Buffers Disabled

Input Current

V_REF= (REF+) − (REF−)

V_REF

AVSS − 0.05

AVSS

AVDD1 + 0.05

AVDD1

µA/V

Input Current Drift

External clock

Internal clock ( 2.5% clock)

0.5

pA/V/°C

nA/V/°C

Input Buffers Enabled

Input Current

Input Current Drift

Crosstalk

0.1

−120

nA/°C

1 kHz input

INTERNAL REFERENCE

Output Voltage

100 nF external capacitor to AVSS

REFOUT, with respect to AVSS

REFOUT, T_A= 25°C

2.5

Initial Accuracy³

−0.12

−10

+0.12

% of V

Temperature Coefficient¹

0°C to 105°C

+10

ppm/°C

−40°C to +105°C

Reference Load Current, I_LOAD

Power Supply Rejection

Load Regulation

AVDD1, AVDD2 (line regulation)

∆V_OUT/∆I_LOAD

e_N, 0.1 Hz to 10 Hz, 2.5 V reference

e_N, 1 kHz, 2.5 V reference

100 nF REFOUT capacitor

4.5

215

200

ppm/mA

µV rms

nV/√Hz

µs

Voltage Noise

Voltage Noise Density

Turn On Settling Time

Short-Circuit Current, I_SC

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