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AD5372

更新时间： 2024-01-09 05:21:45
品牌 Logo 应用领域
亚德诺 - ADI /
页数 文件大小 规格书
25页 301K
描述
32-Channel, 16/14, Serial Input, Voltage-Output DACs

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AD5372 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：LFQFP,针数：64
Reach Compliance Code：unknown风险等级：5.77
最大模拟输出电压：15.1 V最小模拟输出电压：-3.1 V
转换器类型：D/A CONVERTER输入位码：BINARY
输入格式：SERIALJESD-30 代码：S-PQFP-G64
JESD-609代码：e3长度：10 mm
最大线性误差 (EL)：0.0061%湿度敏感等级：3
标称负供电电压：-15 V位数：16
功能数量：1端子数量：64
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260认证状态：COMMERCIAL
座面最大高度：1.6 mm标称安定时间 (tstl)：20 µs
标称供电电压：15 V表面贴装：YES
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：10 mmBase Number Matches：1

AD5372 数据手册

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Preliminary Technical Data  
AD5372/AD5373  
General Description  
The ADAD5372/AD5373 has a high-speed serial interface,  
which is compatible with SPI®, QSPI™, MICROWIRE™, and DSP  
interface standards and can handle clock speeds of up to 50  
MHz.  
The AD5372 and AD5373 contain 32, 16-bit or 14-bit DACs in  
a single, 56-lead, LFCSP or 64-lead LQFP package. The  
AD5372/AD5373 provides buffered voltage outputs with a span  
4 times the reference voltage. The gain and offset of each DAC  
can be independently trimmed to remove errors. For even  
greater flexibility, the device is divided into 4 groups of 8 DACs.  
Two offset DACs allow the output range of the groups to be  
altered. Group 0 can be adjusted by Offset DAC 0, and group 1  
to group 3 can be adjusted by Offset DAC 2.  
The DAC outputs are updated on reception of new data into the  
DAC registers. All the outputs can be updated simultaneously  
LDAC  
by taking the  
input low. Each channel has a program-  
mable gain and an offset adjust register.  
Each DAC output is gained and buffered on-chip with respect  
to an external SIGGND input. The DAC outputs can also be  
The ADAD5372/AD5373 offers guaranteed operation over a  
wide supply range with VSS from -4.5 V to -16.5 V and VDD  
from+8 V to +16.5 V. The output amplifier headroom  
requirement is 1.4 V operating with a load current of 1 mA.  
CLR  
switched to SIGGND via the  
pin.  
Table 1. High Channel Count Bipolar DACs  
Model  
Resolution Nominal Output  
Span  
Output  
Channels  
Linearity Error  
(LSB)  
Package Description Package Option  
AD5360BCPZ  
AD5360BSTZ  
AD5361BCPZ  
AD5361BSTZ  
AD5362BCPZ  
AD5362BSTZ  
AD5363BCPZ  
AD5363BSTZ  
AD5370BCPZ  
AD5370BSTZ  
AD5371BCPZ  
AD5371BSTZ  
AD5372BCPZ  
AD5372BSTZ  
AD5373BCPZ  
AD5373BSTZ  
16 Bits  
16 Bits  
14 Bits  
14 Bits  
16 Bits  
16 Bits  
14 Bits  
14 Bits  
16 Bits  
16 Bits  
14 Bits  
14 Bits  
16 Bits  
16 Bits  
14 Bits  
14 Bits  
16  
16  
16  
16  
8
4
4
1
1
4
4
1
1
4
4
1
1
4
4
1
1
56-Lead LFCSP  
52-Lead LQFP  
56-Lead LFCSP  
52-Lead LQFP  
56-Lead LFCSP  
52-Lead LQFP  
56-Lead LFCSP  
52-Lead LQFP  
64-Lead LFCSP  
64-Lead LQFP  
100-Ball CSPBGA  
80-Lead LQFP  
56-Lead LFCSP  
64-Lead LQFP  
56-Lead LFCSP  
64-Lead LQFP  
CP-56  
ST-52  
CP-56  
ST-52  
CP-56  
ST-52  
CP-56  
ST-52  
CP-64  
ST-64  
BC-100-2  
ST-80  
CP-56  
ST-64  
CP-56  
ST-64  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (20 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
4 × V REF (12 V)  
8
8
8
40  
40  
40  
40  
32  
32  
32  
32  
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