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935286774125

更新时间： 2024-11-25 14:47:27

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恩智浦 - NXP		光电二极管输出元件
页数	文件大小	规格书
27页	242K
描述
AVC SERIES, 2-BIT TRANSCEIVER, TRUE OUTPUT, PDSO8, 3 MM, 0.50 MM HEIGHT, PLASTIC, SOT505-2, TSSOP-8

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935286774125 技术参数

生命周期：	Transferred	包装说明：	TSSOP,
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.58	Is Samacsys：	N
系列：	AVC	JESD-30 代码：	S-PDSO-G8
JESD-609代码：	e4	长度：	3 mm
逻辑集成电路类型：	BUS TRANSCEIVER	位数：	2
功能数量：	1	端口数量：	2
端子数量：	8	最高工作温度：	125 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	SQUARE
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	传播延迟（tpd）：	9.9 ns
座面最大高度：	1.1 mm	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	0.8 V	标称供电电压 (Vsup)：	1.1 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	NICKEL PALLADIUM GOLD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	宽度：	3 mm
Base Number Matches：	1

935286774125 数据手册

74AVC2T45

Dual-bit, dual-supply voltage level translator/transceiver;

3-state

Rev. 7 — 8 February 2013

Product data sheet

1. General description

The 74AVC2T45 is a dual-bit, dual-supply transceiver that enables bidirectional level

translation. It features two data input-output ports (nA and nB), a direction control input

(DIR) and dual-supply pins (V_CC(A)and V_CC(B)). Both V_CC(A)and V_CC(B)can be supplied at

any voltage between 0.8 V and 3.6 V making the device suitable for translating between

any of the low voltage nodes (0.8 V, 1.2 V, 1.5 V, 1.8 V, 2.5 V and 3.3 V). Pins nA and DIR

are referenced to V_CC(A)and pins nB are referenced to V_CC(B). A HIGH on DIR allows

transmission from nA to nB and a LOW on DIR allows transmission from nB to nA.

The device is fully specified for partial power-down applications using I_OFF. The I_OFF

circuitry disables the output, preventing any damaging backflow current through the

device when it is powered down. In Suspend mode when either V_CC(A)or V_CC(B)are at

GND level, both A and B are in the high-impedance OFF-state.

2. Features and benefits

 Wide supply voltage range:

 V_CC(A): 0.8 V to 3.6 V

 V_CC(B): 0.8 V to 3.6 V

 High noise immunity

 Complies with JEDEC standards:

 JESD8-12 (0.8 V to 1.3 V)

 JESD8-11 (0.9 V to 1.65 V)

 JESD8-7 (1.2 V to 1.95 V)

 JESD8-5 (1.8 V to 2.7 V)

 JESD8-B (2.7 V to 3.6 V)

 ESD protection:

 HBM JESD22-A114F Class 3B exceeds 8000 V

 MM JESD22-A115-A exceeds 200 V

 CDM JESD22-C101C exceeds 1000 V

 Maximum data rates:

 500 Mbit/s (1.8 V to 3.3 V translation)

 320 Mbit/s (<1.8 V to 3.3 V translation)

 320 Mbit/s (translate to 2.5 V or 1.8 V)

 280 Mbit/s (translate to 1.5 V)

 240 Mbit/s (translate to 1.2 V)

 Suspend mode

 Latch-up performance exceeds 100 mA per JESD 78 Class II

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